综合性设计性实验设计报告.docVIP

通信系统原理综合性、设计性实验设计报告 帧同步系统电路的设计与实现 8班 001号 张三 002号 李四 系统的功能及性能描述 在时分复用通信系统中，为了正确地传输信息，必须在信息码流中插入一定数量的帧同步码，可以集中插入、也可以分散插入。本系统中帧同步识别码为7位巴克码，集中插入到每帧的第2至第8个码元位置上。 二、系统的结构框图及基本工作原理 帧同步模块的原理框图如图1所示。 图1 帧同步模块原理框图 帧同步系统工作状态分捕捉态和维持态。同步未建立时系统处于捕捉状态，状态触发器Q端为低电平，一旦识别器输出脉冲，由于Q端为高电平，经或门使与门1输出”1”，同时经或门使与门3输出也为”1”，对分频计数器模块清零。与门1一路输出至触发器的S端，Q端变为高电平，与门4打开，帧同步输出脉冲。系统由捕捉态转为维持态，帧同步建立。当帧同步建立后，系统处于维持态。假如此时分频器输出帧同步脉冲，而识别器却没有输出，这可能是系统真的失去同步，也可能是偶然干扰引起的，因此在电路中加入一个保护电路。该保护电路也是一个分频计数器，只有在连续若干次接收不到帧同步信号时，系统才会认为同步状态丢失，由于丢失同步的概率很小，因此这里系统设置分频计数器值为5，也就是说连续5帧接收不到帧同步信号，系统才认为丢失同步状态。当然分频值可设置其他值，但该值越大，同步维持态下漏识别概率也越大。与门1的一路输出置5分频器的使能端，使之开始计数，当计数满时会输出一个脉冲使状态触发器置零，从而无帧同步信号输出，同步电路又进入捕捉态。