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基于Nios II的数字钟设计
学生姓名：
学生学号：
院（系）： 电气信息工程学院
年级专业： 电子信息工程
指导教师：
助理指导教师：
二〇一五年五月
摘要
PAGE \* MERGEFORMAT II
摘 要
传统的设计技术已经不足以满足系统化、网络化、高速度、低功耗、多媒体等实际需要。SOPC用可编程技术把整个系统放在单一的一个芯片上，因此具有灵活、高效、设计可重用等特性。在SOPC系统中，本来需要上几千行的HDL代码的复杂功能模块，经过嵌入IP核后，只需要几十行的C代码就可以简单的实现，由此可以让整个设计规模、功能、功耗、性能指标、开发成本等多个方面实现优化。本论文主要介绍基于NIOS II 的SOPC设计一个数字钟的方法和流程。在本设计中主要分为硬件设计部分和软件设计部分。本系统的硬件开发是根据我所用的FPGA黑金开发板实际器件搭建的，采用QuartersⅡ作为仿真平台。主芯片采用的是Altera 公司的cyclone VI 系列
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