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动态扫描 SCAN2A程序如下： LIBRARY IEEE; USE IEEE.STD_LOGIC_1164.ALL; USE IEEE.STD_LOGIC_UNSIGNED.ALL; ENTITY SCAN2A IS PORT(CLK_SCAN: IN STD_LOGIC; NO1_BCD,NO2_BCD:IN STD_LOGIC_VECTOR(3 DOWNTO 0); SEL:OUT STD_LOGIC_VECTOR(2 DOWNTO 0); DOUT:OUT STD_LOGIC_VECTOR(6 DOWNTO 0)); END SCAN2A; ARCHITECTURE BEHAVE OF SCAN2A IS SIGNAL S1:STD_LOGIC_VECTOR(2 DOWNTO 0); SIGNAL BCD_OUT:STD_LOGIC_VECTOR(3 DOWNTO 0); BEGIN PROCESS(CLK_SCAN) BEGIN IF CLK_SCANEVENT AND CLK_SCAN=1 THEN IF S1001 THEN S1=S1+1; ELSE S1=000; END IF; END IF; END PROCESS; PROCESS(S1) BEGIN CASE S1 IS WHEN000=BCD_OUT=NO1_BCD; WHEN001=BCD_OUT=NO2_BCD; WHEN OTHERS=BCD_OUT=0000; END CASE; END PROCESS; PROCESS(BCD_OUT) BEGIN CASE BCD_OUT IS WHEN0000=DOUT=0111111; WHEN0001=DOUT=0000110; WHEN0010=DOUT=1011011; WHEN0011=DOUT=1001111; WHEN0100=DOUT=1100110; WHEN0101=DOUT=1101101; WHEN0110=DOUT=1111101; WHEN0111=DOUT=0000111; WHEN1000=DOUT=1111111; WHEN1001=DOUT=1101111; WHEN OTHERS=DOUT=1111001; END CASE; * 项目1 EDA系列实验系统介绍 　　一、 实训目的 　 1、熟练掌握用原理图输入法在Quartus II软件下设计数字电路的 步骤。 2、掌握EDA实验箱的使用方法。 3、用原理图输入法设计一位全加器并下载到实验箱进行硬件验证。 　　二、设计要求 用原理图输入法设计一位全加器并进行波形仿真和硬件测试。 三、 实训项目原理 　　 原理图输入法在Quartus II软件下设计数字电路的步骤。 　　四、 实训内容 　　 1、画出一位全加器原理图，并解释。 2、介绍在Quartus II软件平台上如何用原理图输入法设计一位全加器。 3、调试过程。 4、管脚分配及实验箱连线。 五、实训结果 注意：一位全加器并原 理图，见教材P140。 1、绘出仿真波形并分析。 2、给出实验箱上显示的 结果。 项目2 用VHDL语言设计8-3线优先编码器 　　一、 实训目的 　 1、理解优先编码器的逻辑功能。 2、掌握用VHDL语言描述8-3线优先编码器的逻辑功能。 3、学习程序调试的方法。