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Interface)(PPI)101 8255A工作原理 1011 结构和功
* * 并行I/O接口芯片（Programmable Peripherial Interface）(PPI) 10.1 8255A工作原理 10.1.1 结构和功能 第十章 可编程外围接口芯片8255A A组 A口 （8位） PA7~PA0 RESET WR A组 C口高位 （4位） PC7~PC4 A组 C口低位 （4位） PC3~PC0 B组 B口 （8位） PB7~PB0 数据总线 缓冲器） A组 控制 读写 控制 逻辑 RD CS A0 A1 B组 控制 1 40 2 39 3 38 4 37 5 36 6 35 7 34 8 33 9 32 10 31 11 30 12 29 13 28 14 27 15 26 16 25 17 24 18 23 19 22 20 21 8255A PA3 PA2 PA1 PA0 RD CS GND A1 A0 PC7 PC6 PC5 PC4 PC0 PC1 PC2 PC3 PB0 PB1 PB2 PA4 PA5 PA6 PA7 RW RESET D0 D1 D2 D3 D4 D5 D6 D7 VCC PB7 PB6 PB5 PB4 PB3 （1）数据端口A、B、C A口：双向，8位，可工作于方式0、1、2 B口：双向，8位，可工作于方式0、1 C口：1）双向，8位 2）双向，4位×2 3）配合产生A、B口控制信号 （2）A、B组控制逻辑 1）决定A、B组工作方式 2）对C口每一位置/复位 （3）数据总线缓冲器 双向，8位，三态 （4）读/写控制逻辑 管理所有的内部或外部数据信息、控制字或状态字的传送过程。 （5）RESET 高电平有效 将8255A空载寄存器内容清0，并将A、B、C口置为输入方式。 8255A基本操作表 数据总线为三态（高阻） 非法状态 数据总线为三态（高阻） 1 0 0 X 1 1 X 0 1 X 1 X X 1 X 端口A→数据总线 端口B→数据总线 端口C→数据总线 0 0 0 1 1 1 0 0 0 0 1 0 0 0 1 数据总线→端口A 数据总线→端口B 数据总线→端口C 数据总线→控制字寄存器 0 0 0 0 0 0 0 0 1 1 1 1 0 1 0 1 0 0 1 1 操作 CS WR RD A0 A1 10.1.2 控制字 1）方式选择控制字 方式0 —— 基本输入输出方式 方式1 —— 选通输入输出方式 方式2 —— 双向总线I/O方式 2）置位/复位控制字 可使C口任一引脚单独置1或清0，或者为应答式数据传送发中断请求信号。 D7│D6│ D5 │D4│D3│D2│D1│D0 C口低4位选择（方式0时） 1=输入 0=输出 B口输入输出选择 1=输入 0=输出 B口工作方式选择 1=方式1 0=方式0 B组 A组 C口高4位输入输出选择 1=输入 0=输出 A口输入输出选择 1=输入 0=输出 A口工作方式选择 01=方式1 00=方式0 1x=方式2 D7 =1标志位 方式选择控制字 1）方式选择控制字 D7│D6│ D5 │D4│D3│D2│D1│D0 无关 D7=0 标志位 置位/复位控制字 对某一位——
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