关于主从板时钟同步问题.docVIP

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2017-06-08 发布于重庆
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关于主从板时钟同步问题.doc

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关于主从板时钟同步问题

关于主从板时钟同步问题在我们系统中，主板与从板之间通过交换网片的HW0、HW4互连，要使主板与从板的交换网之间能够正常交换，必须使这两个交换网片有一致的帧同步时钟及位同步时钟。在现在的单板中，从板的时钟由主板直接送出。整个系统采用的时钟源有3种方式：方式1、由主板的16.384MHz晶振作为分频时钟源方式2、由主板的E1接口输出的2.048MHz经过PLL倍频为16.384MHz后作为分频的时钟源方式3、由从板的E1接口输出的2.048MHz经过PLL倍频为16.384MHz后作为分频的时钟源时钟源的选择由由控制寄存器3的值决定。系统在初始化时该寄存器的初始值为0000，选择方式1。下图为系统的同步时钟生成部分框图：下面对3种时钟源做个说明：系统上电初始化或者系统复位时，主板的CPLD1将时钟源切换为方式1。此时主板的DSP，E1芯片，DSP的PCM同步时钟由晶振16.384MHz经主板CPLD分频产生，同时CPLD1将这些同步时钟经背板送至从板CPLD2，作为相应器件的同步时钟。系统初始化完成，已经知道主从板E1的状态了，此时可以将寄存器的值置为0001或者0010，主要是由E1的状态来决定。如果从板E1不可用，CPU将CPLD的值设为0001，即方式2。此时由主板的E1接口输出的2.048MHz经过PLL倍频为16.384MHz后作为分频的时钟源，产生DSP，E1芯片，DSP的PCM同步时钟，并将这些时钟送至从板。如果主板的E1不可用，CPU将CPLD的值设为0010，即方式3。此时由从板的E1接口输出的2.048MHz经过PLL倍频为16.384MHz后作为分频的时钟源，产生DSP，E1芯片，DSP的PCM同步时钟，并将这些时钟送至从板。