一种用于高速高精ADC的电压基准源设计.docVIP

引言随着集成电路规模不断扩大，尤其是芯片系统集成技术的提出，对模拟集成电路基本模块(如A／D、D／A转换器、滤波器以及锁相环等电路)提出了更高的精度和速度要求，这也就意味着系统对其中的基准源模块提出了更高的要求。用于高速高精度ADC的片内电压基准源不仅要满足ADC精度和采样速率的要求，并应具有较低的温度系数和较高的电源抑制比，此外，随着低功耗和便携的要求，ADC也在朝着低压方向发展，相应的基准源也要满足低电源电压的要求。本文分析了基准源对流水线ADC精度的影响，并建立了相应的模型，确定了高速高精度ADC对电压基准源的性能要求。给出了基于1.8 V的低电源电压，并采用结构简单的VBE非线性二阶补偿带隙基准源的核心电路，该补偿方式可以实现较低的温度系数，能满足高速高精度ADC的要求。箝位运放采用一种低噪声两级运算放大器，该运放可提供小于0.02 mV的失调电压，因而保证了基准源的补偿精度。为了提高基准源的电源抑制比，本文除采用常用的共源共栅电流镜技术以外，还设计了一种简单有效的电源抑制比提高电路，从而使得基准源的电源抑制比有了较大提高。1? 电压基准源影响的建模分析在Pipelined ADC系统中，基准源的主要作用是为子ADC提供比较电平，同时为MDAC提供残差电压。差分基准电压源发生偏移会导致子ADC比较电平和MDAC残差电压发生变化。而通过引入冗余位矫正技术可