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第五章 8086CPU总线结构和时序 5.1 8086系统总线结构 5.1 8086系统总线结构 5.2 8086系统总线时序 * 5.1 8086系统总线结构 5.2 8086系统总线时序 两级总线：微处理器级总线——CPU的输入输出引脚；系统级总线——CPU通过微处理器级总线和其它逻辑电路连接组成主机板系统，形成系统级总线。 总线控制逻辑：微处理器级总线和系统级总线之间的接口逻辑电路。 总线周期：8086CPU通过总线对存储器和I/0接口进行一次访问所需的时间，一个基本的总线周期包括4个时钟周期。 最小方式：只有一个微处理器8086 ，所有控制信号由8086产生。该模式适用于规模较小的微机应用系统。 最大方式：系统有两个或多个同时执行指令的微处理器，其中一个主处理器就是8086，其它的处理器称协处理器（数值协处理器8087和输入/输出协处理器8089）。最大模式用在中、大规模的微机应用系统中。 5.1.1 两种工作方式下的公用引脚 电源、接地引脚 ： VCC、GND（1和20） 时钟信号：CLK，方波信号，占空比约为33% 8086CPU共有40根引脚线，其中32根在两种方式下名称和功能相同。 20根地址/数据线； 16根控制线，其中8根在两种工作方式下名称和功能相同。 0102030405060708091011121314151617181920