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- 2016-12-14 发布于湖北
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PLL0MUL:PLL 时钟倍频寄存器 位7-0: PLLN7-0:PLL 倍频系数。 这些位选择分频PLL 参考时钟的倍频系数。当被设置为非0 值时,倍频系数 等于PLLN7-0 中的值。当被设置为’时,倍频系数等于256。 除此之外,根据期望的频率范围来配置环路滤波器和ICO 是很重要的。 应根据分频后的参考时钟频率设置PLLLP3-0位(PLL0FLT.3-0),根据所期望的输出频率范围来设置PLLICO1-0 位(PLL0FLT.5-4)。 当PLL 锁定并稳定在所期望的频率时,PLLLCK位(PLL0CN.5)被置‘1’。PLL 的输出频率由下面的方程设定: PLL0FLT:PLL 滤波器寄存器 位7-6: 未用:读 = 00b,写 = 忽略。 位5-4: PLLICO1-0:PLL 电流控制振荡器控制位。 根据所期望的输出频率选择这两位的值,见下表: PLL0FLT:PLL 滤波器寄存器 位3-0: PLLLP3-0:PLL 环路滤波器控制位。 根据分频后的PLL 参考时钟选择这两位的值,见下表: PLL0CN:PLL 控制寄存器 位7-5: 未用:读 = 000b,写 = 忽略。 位4: PLLLCK:PLL 锁定标志。 0:PLL 频率未锁定。 1:PLL 频率已锁定。 位3: 保留。必须写‘0’。 位2: PLLSRC:PLL 参
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