实验三 几种逻辑功能描述电路设计.ppt

EDA课程 实验三 三种逻辑功能电路描述方法设计 Verilog的 内置门元件 module mux4_1a(out,in1,in2,in3,in4,s0,s1); input in1,in2,in3,in4,s0,s1; output out; wire s0_n,s1_n,w,x,y,z; not (s0_n,s0),(s1_n,s1); and (w,in1,s0_n,s1_n),(x,in2,s0_n,s1), (y,in3,s0,s1_n),(z,in4,s0,s1); or (out,w,x,y,z); endmodule 2、 数据流描述 数据流描述方式主要使用持续赋值语句，多用于描述组合逻辑电路，其格式为： assign LHS_net=RHS_expression; 右边表达式中的操作数无论何时发生变化，都会引起表达式值的重新计算, 并将重新计算后的值赋予左边表达式的net型变量。 数据流描述 用数据流描述模式设计电路与用传统的逻辑方程设计电路很相似。设计中只要有了布尔代数表达式就很容易将它用数据流方式表达出来。表达方法是用Verilog中的逻辑运算符置换布尔逻辑门运算符即可。 比如，如果逻辑表达式为： 则用数据流方式描述为： assign F=(ab)|(~(cd))。 module mux4_1c(out,in