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三、可编程中断控制器8259A D0 D1 分别记作RIS和RR，D2 =0（即P=0）且RR＝1时可对8259A内部寄存器进行读出操作。其中，D0 D1＝01，则下一条同一地址（A0=0）的输入指令会将8259A中IRR的内容读入CPU；D0 D1＝11，则下一条同一地址（A0=0）的输入指令读入CPU的是 ISR中的内容。 若D2＝1，查询申请中断服务的最高优先级。此时CPU处于关中断，通过输入指令(A0=0)读8259A的状态，可读得如下8位数据：IXXXXW2W1W2。若I＝0，表明8259A无中断请求；I＝1，表示有中断请求，其中W2W1W2的组合指出请求服务的各中断源中最高的中断级。 D7 D6 D5 D4 D3 D2 D1 D0 W0 W1 W2 X X X X I 三、可编程中断控制器8259A D5 D6 分别记作SMM和ESMM，用于设置特殊屏蔽方式。D5＝0，本设置无效，系统将按IMR的设置，实施普通中断屏蔽方式；D5 D6 ＝01，复位特殊屏蔽方式；D5 D6 ＝11，置位特殊屏蔽方式，此时即使在较高级中断服务过程中也可穿插对较低级中断的服务。 三、可编程中断控制器8259A * 二、中断的基本概念 保护模式下的中断矢量表只有前5个与实模式中断矢量表相同，其它的中断矢量不兼容8086/8088系统。 助记符 含义 格式 功能操作 影响标志位 CLI STI 软件设置 中断允许IF CLI STI (IF)←0 (IF)←1 IF INT 两字节软件 中断指令 INT n [实模式]:((SP)-2)←(Flags) TF和IF清零，((SP)-4)←(CS), (CS)←(2+4×n),((SP)-6)←(IP), (IP)←(4×n) TF,IF IRET 中断返回 IRET [实模式]: (IP)←((SP)), (CS)←((SP)+2), (Flags)←((SP)+4),(SP)←(SP)+6 全部 INTO 溢出中断 INTO 当OF置1时，转向INT 4 TF,IF HLT 暂停 HLT 等待中断，或CPU复位 无 WAIT 等待 WAIT 等待BUSY引脚的信号为无效 无 中断有关指令及其功能 二、中断的基本概念 INTR中断响应过程 CPU接受请求后，进入中断响应总线周期： 1)在中断响应的总线周期中，CPU自动完成保护断点、关中断 保护断点：(SP)←(SP)-2,((SS):(SP))←(FR) (SP)←(SP)-2,((SS):(SP))←(CS) (SP)←(SP)-2,((SS):(SP))←(IP) 关中断： (IF)←0 (TF)←0 二、中断的基本概念 中断的优先权（Priority） 优先权的管理原则 所谓优先权就是当有多个中断申请时，根据轻重缓急，规定一个中断响应的次序。优先权管理原则主要处理下面几个问题： ①不同优先级级中断源同时 申请中断； ②较低级的正在执行中断服务 程序中，又有较高级的申请； ③较高级的正在执行中断服 务程序中,又有较低级的申请； ④ 同级中断的同时申请处理 优先级 高 低 中断/异常 内部中断及异常 软件中断 NMI中断 INTR中断 8086中断优先级 内部异常（除单步中断） INT n NMI INTR 单步中断 二、中断的基本概念 比较：中断控制与子程序调用 中断控制 子程序调用 程序进入方式 外部随机请求 CALL指令 程序进入时刻 当前指令执行后 执行CALL指令后 保护/恢复现场 视需要设置 视需要设置 保护/恢复断点 PSW/CS/IP CS/IP 返回主程序指令 执行IRET 执行RET 参数传递 无 无 二、中断的基本概念 中断服务子程序结构 1）保护现场(类似于执行通用子程序） 2）开中断（可选） 3）执行关于当前中断源或异常处理所要求的I/O等程序操作 4）关中断（可选） 5）恢复现场 6）中断返回 Y N Y Y N N 二、中断的基本概念 1. 中断请求 中断源如有中断请求，应向CPU的INTR引脚输入高电平中断请求信号。 2. 中断响应 CPU 在每条指令的最后一个机器周期的最后一个时钟周期，检测INTR有无请求信号。 3. 断点保护 一旦CPU响应中断并进入中断响应周期，为使中断服务程序不影响被中断的原程序后续的运行，需要利用堆栈保护断点处 CPU 标志寄存器的内容。 4. 中断服务 针对具体中断源完成预期的服务程序处理部分。 5. 断点恢复 即恢复进入中断服务程序之前在堆栈中保存的 CPU 标志寄存器内容，以使中断返回时现场不被破坏。 6.