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xilingsnow@163.com 2010年7月18日 7月18 上午、晚上 7月19日-27日上午、下午 7月18日 完成课程实验(组合、时序两部分)。 7月18日-20日 完成数字系统设计进阶内容练习(第9章 Verilog HDL进阶、第10章 数字设计的优化) 7月21日 内容总结、设计分组,选题。 7月21日-26日 设计ing…… 7月27日 设计完成、论文整理、验收。 课程设计题目一:多功能数字钟 课程设计题目二:数字频率表 课程设计题目三:数字密码锁 分组人数:小于3人/组 每组设组长一名,负责任务分配和组内统筹 每组按照选题,完成基本功能基础上,尽量扩展。 成绩按组给分,组内排序,按照贡献大小进行上下调整。 提交论文、源代码(.v、.sof文件)。 论文:系统的设计功能、分析过程、模块划分、核心代码、开发难点及解决方案、总结。 按照实习安排作息,不能迟到、早退。 每组组长负责本组人员的考勤。 论文作业准时提交。 爱护设备。 □张三 □李四 组长 □王五
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