20电工学第七版_第20章_门电路和组合逻辑电路2试卷.ppt

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2017-03-14 发布于湖北
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20.5 逻辑代数 1. 常量与变量的关系 20. 5. 3 逻辑函数的化简 1. 用 “与非”门构成基本门电路 20. 6 组合逻辑电路的分析与综合 20. 6. 1 组合逻辑电路的分析 20. 6. 2 组合逻辑电路的综合 20. 7 加法器 20. 7 加法器 20. 7. 1 半加器 20. 7. 2 全加器 20. 8 编码器 20. 8. 2 二 – 十进制编码器 20.9 译码器和数字显示 74LS139型译码器 20. 9. 2 二-十进制显示译码器 20. 10 数据分配器和数据选择器 20. 10. 1 数据选择器例: 20. 10. 2 数据分配器数据分配器的功能表 20. 11 应用举例当有两个或两个以上的信号同时输入编码电路，电路只能对其中一个优先级别高的信号进行编码。即允许几个信号同时有效，但电路只对其中优先级别高的信号进行编码，而对其它优先级别低的信号不予理睬。 20. 8. 3 优先编码器 74LS4147 编码器功能表 I9 Y0 I8 I7 I6 I5 I4 I3 I2 I1 Y1 Y2 Y3 1 1 1 1 1 1 1 1 1 1 1 1 1 输入 (低电平有效) 输出(8421反码) 0 ? ? ? ? ? ? ? ? 0 1 1 0 1 0 ? ? ? ? ? ? ? 0 1 1 1 1 1 0 ? ? ? ? ? ? 1 0 0 0 1 1 1 0 ? ? ? ? ? 1 0 0 1 1 1 1 1 0 ? ? ? ? 1 0 1 0 1 1 1 1 1 0 ? ? ? 1 0 1 1 1 1 1 1 1 1 0 ? ? 1 1 0 0 1 1 1 1 1 1 1 0 ? 1 1 0 1 1 1 1 1 1 1 1 1 0 1 1 1 0 例: 74LS147集成优先编码器(10线-4线) 74LS147引脚图低电平有效 16 15 14 13 12 11 10 9 1 2 3 4 5 6 7 8 74LS4147 译码是编码的反过程，它是将代码的组合译成一个特定的输出信号。 20. 9. 1 二进制译码器 8个 3位译码器二进制代码高低电平信号状态表例：三位二进制译码器（输出高电平有效）输入 A B C Y0 Y1 Y2 Y3 Y4 Y5 Y6 Y7 0 0 0 1 0 0 0 0 0 0 0 0 0 1 0 1 0 0 0 0 0 0 0 1 0 0 0 1 0 0 0 0 0 0 1 1 0 0 0 1 0 0 0 0 1 0 0 0 0 0 0 1 0 0 0 1 0 1 0 0 0 0 0 1 0 0 1 1 0 0 0 0 0 0 0 1 0 1 1 1 0 0 0 0 0 0 0 1 输出写出逻辑表达式 Y0=A B C Y1=A B C Y2=A B C Y3=A B C Y7=A B C Y4=A BC Y6=A B C Y5=A B C 逻辑图 C B A 1 1 1