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嵌入式实时操作系统
μC/OS-II;第3章 uC/OS-II 的中断和时钟;第3章 目录;第3章 目录;3.1 uC/OS-II 的中断;ARM 处理器中断控制原理：;;异常向量表
Reset
LDR PC, ResetAddr
LDR PC, UndefinedAddr
LDR PC, SWI_Addr
LDR PC, PrefetchAddr
LDR PC, DataAbortAddr
DCD 0xb9205f80
LDR PC, [PC, #-0xff0]
LDR PC, FIQ_Addr
ResetAddr DCD ResetInit
UndefinedAddr DCD Undefined
SWI_Addr DCD SoftwareInterrupt
PrefetchAddr DCD PrefetchAbort
DataAbortAddr DCD DataAbort
Nouse DCD 0
IRQ_Addr DCD 0
FIQ_Addr DCD FIQ_Handler; FIQ 中断的响应：;IRQ_ISR地址映射关系图 ;;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;补充：ARM中的中断优先级资源;补充：ARM中的中断优先级资源;ARM状态各模式下可以访问的寄存器;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;3.1 uC/OS-II 的中断;第3章 目录;3.2 uC/OS-II 的时钟;3.2 uC/OS-II 的时钟;第3章 目录;3.3 uC/OS-II 的时间管理 ----（任务延时、取消延时、获取/设置系统时间等操作）;取消任务的延时;获取/设置系统时间
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