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一种用于DCDC中电荷泵锁相环的设计 西南交通大学 硕士学位论文 一种用于DC-DC中电荷泵锁相环的设计 姓名：黄可 申请学位级别：硕士 专业：电路与系统 指导教师：冯全源 西南交通大学硕士研究生学位论文 摘要 锁相环是一种相位负反馈控制系统，它能使受控振荡器的频率和相位与输入信号保持一种确定的关系，为各类数模混合集成系统提供精确的振荡信号。随着集成电路的发展，直流电源转换器变频工作模式的存在，使锁相环在ＤＣ．ＤＣ变换器中占据了举足轻重的地位。 电荷泵锁相环是一种典型的数模混合锁相环，由鉴频鉴相器、电荷泵、低通滤波器和压控振荡器组成。电荷泵和压控振荡器是电荷泵锁相环的两个核心电路模块。鉴频鉴相器死区的存在、电荷泵电路存在的电荷泄漏、电荷共享和泵开关延时等非理想效应，以及压控振荡器电路的增益大小和频率．电压线性度，都对锁相环环路性能产生很大影响。本文在分析锁相环各电路模块工作原理的基础上，主要研究电荷泵电路的非理想性和压控振荡器增益对环路稳定性的影响，针对压控振荡器增益过大影响环路稳定性问题，采用了压控振荡器增益补偿技术。在振荡器中增加电压变换电路，设计实现一种具有低增益低灵敏度的压控振荡器。用该压控振荡器实现了一种能够产生稳定低频时钟信号的电荷泵锁相环。 本次设计基于ＴＳＭＣ０．１８ｕｍ．ＣＭＯＳ工艺，采用ＶｉｅｗＤｒａｗ软件完成电路 Ｌａｙｏｕｔ级的设计和Ｃａｄｅｎｃｅ软件下的ＶｉｒｔｕｏｓｏＥｄｉｔｏｒ完成版图设计，并借助 ＨＳＰＩＣＥ仿真软件对模块电路进行功能仿真验证，以及完成对锁相环路的功能和关键性能的仿真验证。仿真结果表明，在３．３Ｖ的电源电压下，本文实现的电荷泵锁相环能够在．４０℃～８５℃温度范围内与外部时钟同步于１．５ＭＨｚ～３．５ＭＨｚ的频率范围，锁定时间小于６９ｕｓ，功耗小于１．３ｍＷ，能够应用于ＤＣ．ＤＣ变换器中，证实了设计的合理性。关键词：电荷泵锁相环；压控振荡器；外同步；频率 西南交通大学硕士研究生学位论文 Ａｂｓｔｒａｃｔ ＰＬＬ（ｐｈａｓｅ—ｌｏｃｋｅｄｌｏｏｐ）ｉｓ ｅｎａｂｌｅｓｔｏｍａｉｎｔａｉｎ ｏｆａｎａｎｅｇａｔｉｖｅｆｅｅｄｂａｃｋｃｏｎｔｒｏｌｓｙｓｔｅｍ，ｗｈｉｃｈｅｓｔａｂｌｉｓｈｅｄｒｅｌａｔｉｏｎｓｈｉｐｂｅｔｗｅｅｎｔｈｅｆｒｅｑｕｅｎｃｙａｎｄｐｈａｓｅＶＣＯ（ｖｏｌｔａｇｅ－ｃｏｎｔｒｏｌｌｅｄｏｓｃｉｌｌａｔｏｒ）ａｎｄｔｈａｔｏｆｔｈｅｉｎｐｕｔｓｉｇｎａｌ．Ｗｉｔｈｄｅｖｅｌｏｐｍｅｎｔｏｆｉｎｔｅｇｒａｔｅｄｃｉｒｃｕｉｔｓ，ｔｈｅｅｘｉｓｔｅｎｃｅｏｆｔｈｅｖａｒｉａｂｌｅｆｒｅｑｕｅｎｃｙｍｏｄｅｏｆＤＣ－ＤＣｃｏｎｖｅｒｔｅｒｓｌｅｔｓＰＬＬｏｃｃｕｐｙａｐｉｖｏｔａｌｐｏｓｉｔｉｏｎｉｎｔｈｅＤＣ－ＤＣｃｏｎｖｅｒｔｅｒｓ． ａＣｈａｒｇｅ－ｐｕｍｐｐｈａｓｅ－ｌｏｃｋｅｄｌｏｏｐｉｓ ｃｏｎｓｉｓｔｓｏｆｔｙｐｉｃａｌｍｉｘｅｄｐｈａｓｅ—ｌｏｃｋｅｄｌｏｏｐ，ｗｈｉｃｈｐｕｍｐ，ｌｏｗ－ｐａｓｓｆｉｌｔｅｒａｎｄＶＣＯ．ＰＦＤ（ｐｈａｓｅｆｒｅｑｕｅｎｃｙ ａｒｅｄｅｔｅｃｔｏｒ），ｃｈａｒｇｅｃｏｒｅＣｈａｒｇｅｐｕｍｐａｎｄＶＣＯ ｌｏｏｐｃｉｒｃｕｉｔ．Ｎｏｎ—ｉｄｅａｌｔｗｏｍｏｄｕｌｅｓｏｆｔｈｅｃｈａｒｇｅｐｕｍｐｐｈａｓｅ－ｌｏｃｋｅｄａｓｅｆｆｅｃｔｓｓｕｃｈｄｅａｄｚｏｎｅｉｎＰＦＤ，ｃｈａｒｇｅｌｅａｋａｇｅ， ｏｎｃｈａｒｇｅ－ｓｈａｒｉｎｇａｎｄｓｗｉｔｃｈｄｅｌａｙｉｎｃｈａｒｇｅｐｕｍｐｃｉｒｃｕｉｔｈａｖｅｓｉｇｎｉｆｉｃａｎｔｉｍｐａｃｔ ｐｅｒｆｏｒｍａｎｃｅｏｆｔｈｅＰＬＬ．ＴｈｅＶＣＯｇａｉｎａｎｄｆｒｅｑｕｅｎｃｙ—ｖｏｌｔａｇｅｌｉｎｅａｒｉｔｙａｌｓｏｈａｖｅｉｎｆｌｕｅｎｃｅｏｎｔｈｅｐｅｒｆｏｒｍａｎｃｅｏｆＰＬＬ．Ｂａｓｅｄｏｎａｎａｌｙｓｉｓｏｆｔｈｅｐｒｉｎｃｉｐｌｅｏｆｐｈａｓｅ?ｌｏｃｋｅｄｌｏｏｐｃｉｒｃｕｉｔ，ｔｈａｔｎｏｎ－ｉｄｅａｌｅｆｆｅｃｔｓｉｎｃｈａｒｇｅ—ｐｕｍｐｃｉｒｃｕｉｔａｎｄＶＣＯｇａｉｎｈａｖｅｅｆｆｅｃｔ ｕｓｅｏｎｔｈｅｌｏｏｐｓｔａｂｉｌｉｔｙｉｓｍａｉｎｌｙｓｔｕｄｉｅｄｉｎｔｈｉｓｐａｐｅｒ．ＡｎｄｍａｋｉｎｇｏｆｔｈｅＶＣＯｇａｉｎｃｏｍｐｅｎｓａｔｉｏｎｔｅｃｈｎｉｑｕｅｒｅｓｏｌｖｅｓｔｈｅｉｓｓｕｅｔｈａｔｌａｒｇｅＶＣＯ ｅｆｆｅｃｔｓｔｈｅｌｏｏｐｓｔａｂｉｌｉｔｙ．Ｔｈａｔ ａｇａｉｎｖｏｌｔａｇｅ