EDA刘艳萍第4章习题答案.docVIP

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2017-05-06 发布于重庆
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EDA刘艳萍第4章习题答案.doc

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EDA刘艳萍第4章习题答案

第四章习题（参考答案） 4-3: (1) LIBRARY ieee; USE ieee.std_logic_1164.all; USE ieee.std_logic_arith.all; ENTITY counter IS GENERIC( max_value: integer:= 15); PORT (clk,clr,en,load,dir： in std_logic; data_in： in integer range 0 to max_value; Count： out integer range 0 to max_value; co: out std_logic); END counter; ARCHITECTURE a OF counter IS signal cnt: integer range 0 to max_value; BEGIN PROCESS (clr,clk) BEGIN if clr =’0’then cnt = 0; elsif (clk’event and clk = 1) then if load = 1 then cnt = data_in; elsif en = 1 then if dir = 1 then if cnt = max_value then cnt = 0; else cnt = cnt + 1; end if; else if cnt = 0 then cnt = max_value; else cnt = cnt - 1; end if; end if; end if; end if; END PROCESS; count = cnt; Co=‘1’when (cnt=max_value and dir=‘1’) or (cnt=0 and dir=‘0’) else ‘0’; End a; （2）计数结果由共阴极七段数码管显示 LIBRARY ieee; USE ieee.std_logic_1164.all; USE ieee.std_logic_arith.all; ENTITY counter IS GENERIC( max_value: integer:= 15); PORT (clk,clr,en,load,dir： in std_logic; data_in： in integer range 0 to max_value; Count： out std_logic_vector(0 to 6); co: out std_logic); END counter; ARCHITECTURE a OF counter IS signal cnt: integer range 0 to max_value; BEGIN PROCESS (clr,clk) BEGIN if clr =’0’ then cnt = 0; elsif (clk’event and clk = 1) then if load = 1 then cnt = data_in; elsif en = 1 then if dir = 1 then if cnt = max_value then cnt = 0; else cnt = cnt + 1; end if; else if cnt = 0 then cnt = max_value; else cnt = cnt - 1; end if; end if; end if; end if; END PROCESS; Co=‘1’when (cnt=max_value and dir=‘1’) or (cnt=0 and dir=‘0’) else ‘0’; with cnt select count=“0000110 when 1, --1 “1011011 when 2, --2 “1001111 when 3, --3