张纪成版《数字电路》实验题目.docVIP

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2017-05-31 发布于北京
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张纪成版《数字电路》实验题目.doc

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实验题目实现异或运算电路用与非门7400、非门7404实现。用或非门7402、非门7404实现。实现同或运算电路用与非门7400、非门7404实现。用或非门7402、非门7404实现。用与非门7400、或非门7402实现与运算Ｙ＝ＡＢＣＤ或运算Ｙ＝Ａ＋Ｂ＋Ｃ＋Ｄ设计一个3变量多数判别电路，当输入A、B、C中有2个或2个以上为1时，输出Y为1，否则输出Y为0。用与非门7400、7420实现。用3-8译码器74138和与非门7420实现。用异或门7486实现设计一个4变量奇偶判别电路，当输入A、B、C、D中有奇数个1时，输出Y为1，否则输出Y为0。设计一个4变量奇偶判别电路，当输入A、B、C、D中有偶数个1时，输出Y为1，否则输出Y为0。用3-8译码器74138和与非门7420实现设计一个3变量奇偶判别电路，当输入A、B、C中有奇数个1时，输出Y为1，否则输出Y为0。设计一个3变量奇偶判别电路，当输入A、B、C中有偶数个1时，输出Y为1，否则输出Y为0。设计一个3变量的逻辑一致判别电路，当输入A、B、C取值相同时，输出Y为1，否则输出Y为0。用与非门7400、7420实现。用数据选择器74153和非门7404实现。用与非门7400和异或门7486设计一个一位半加器，设输入A、B为被加数、加数，S、C为该位和及向高一位的进位。设计一个一位全加器，设输入A、B、CI为被加数、加数、低一位来的进位，S、CO为该位和及向高一位的进位。用与非门7400、异或门7486实现。用3-8线译码器74138和与非门7420实现。用数据选择器74153和非门7404实现