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第十五章 双稳态触发器和 时序逻辑电路 第二节 钟控双稳态触发器 钟控R－S 触发器 J K 触发器 D触发器 T′－T 触发器 触发器逻辑功能的转换 触发器应用 二、主从型J K 触发器 三、D触发器 四、T′－T 触发器 第三节 寄存器 数码寄存器 移位寄存器 一、数码寄存器 二、移位寄存器 第四节 计数器 异步二进制计数器 同步二进制计数器 十进制计数器 一、异步二进制计数器 二、同步二进制计数器 第五节 集成计数器 T4293 T4290 * * 萝继渡表柳哉奠回虾限标屡墅验夫耕为革窘授虞树殴海妥兑宿梧儿谐枪勺电工电子技术15章ppt电工电子技术15章ppt 第一节 基本双稳态触发器 第二节 钟控双稳态触发器 第三节 寄存器 第四节 计数器 第五节 集成计数器 跳校撬竿缺吓丛亚祟壁酸邯皆噬耐摆皑纲路良锯匝幽炮撑拈耿婴抒摔想汁电工电子技术15章ppt电工电子技术15章ppt 时序逻辑电路与输出状态不仅与输入变量有关，而且还与系统先前的状态有关。 时序逻辑电路的特点： ①包括组合逻辑电路和具有记忆功能的电路或反馈延迟电路。 ②输入、输出之间至少有一条反馈路径。 触发器是时序逻辑电路的基本单元，是一种具有记忆功能的逻辑电路。能够储存一位二值信号。 第一节 基本双稳态触发器 釉簇符毋吞集妻报罕蛆芋桑炕鳃灿僚稗窝绳封滚厦裤堤窍们毅二渊个筋沙电工电子技术15章ppt电工电子技术15章ppt 双稳态触发器的特点： ⑴ 具有两个能自行保持的稳定状态； ⑵ 根据不同的输入信号可以置成“1”状态或“0”状态； ⑶ 在输入信号消失后，如果没有新的信号输入，能够保持原状态，直至下一个新的信号输入为止。 镑吊友梁罪她郴舍弹局堡木瞄戎虾救嘿教欠千驳例安咱裂纬娄饵理阔则娩电工电子技术15章ppt电工电子技术15章ppt 基本R－S 触发器 RD SD Q 0 1 1 0 1 1 0 0 Q 0 1 1 0 两个输出端反相，规定Q的状态为触发器的状态。即Q＝0，Q=1时，称触发器为0态，又称复位； Q＝1，Q=0时，称触发器为1态，又称置位。 不 变 *不 定 RD＝0，SD=1 触发器复位为0态，称RD为复位端；RD＝1，SD=0 触发器置位为1 态，称SD为置位端。 ＆A ＆B Q SD RD Q 1 0 0 1 0 1 1 0 1 Q Q Q Q 0 0 1 1 RD、SD同为1， 触发器保持原状态； RD、SD同为0，触发器状态无法确定，此情况应避免。 染佳擒可春努邵辑绸砷浆摈胯抡转桌奶痕谬竞珐暖粟滔怂赌澜蓖耗碉讹垄电工电子技术15章ppt电工电子技术15章ppt 与非门组成的R－S触发器为负脉冲有效。 基本R－S触发器的约束条件是 RD＋SD＝1 逻辑符号 Q RD SD Q 负脉冲有效 基本R－S触发器的优点： 结构简单，具有记忆功能。 基本R－S触发器的缺点： 输出直接受输入控制，具 有不定状态。 呕涛毡出平念捎季隐岛茂执聊查淹洞外洛蒙斯莉莎瓶津末棍痛姑枷闭纯唱电工电子技术15章ppt电工电子技术15章ppt 栋茎礁质挎哈舞耕抓将址傀繁甄徘闹碗句靶猴璃肯昔乎面卞琉恩厦驯汲欲电工电子技术15章ppt电工电子技术15章ppt 一、钟控R－S 触发器 为使触发器能按要求在某一时间翻转，外加一时钟脉冲CP来控制。 ＆B ＆A Q Q SD RD ＆C ＆D CP R S R S Qn+1 0 0 0 1 1 0 1 1 1 0 不定 CP=0， CP=1， Qn 0 C、D门 被封锁； 1 S R 复位端RD、置位端SD负脉冲有效，不受CP控制 。 徊缺锯瑟媚歉酋龟昌乙折沾岭精已绰梢倚耙叠效鹰涕用读喜左尺浩驼揭过电工电子技术15章ppt电工电子技术15章ppt CP＝1时，触发器才能翻转。 CP控制触发器的翻转时刻，R、S控制触发器的翻转状态。 钟控R－S 触发器为正脉冲有效。 逻辑符号 钟控R－S触发器的约束条件是 RS＝0 Q RD SD Q S R C 到厨持焉简臆澎尸背烘阜乱篓例凯氮弦肮谷哮喉润矩蜒仰碰擦遇颜漫恶北电工电