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allegr 16.3 约束规则设置
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Allegro 16.3约束规则设置
约束管理器是一个交叉的平台,以工作簿和工作表的形式在 Cadence PCB设计流程中用于管理所有工具的高速电
子约束。可以使用约束管理器和SigXplorer Expert 开发电路的拓扑并得出电子约束,可以包含定制约束、定制测量和
定制激励。
所谓约束就是用户定义的限制条件,当在板上走线和放置元件时会遵守这些约束。电子约束(ECSets )就是限制
PCB 上与电行为有关的对象,比如可以设置某个网络最大传输延迟为2ns 。
以下图为一约束设置窗口。
一、说明
先解释一下约束的类型以及约束中用到的简写名词,如下图所示:
冉 腔 揪 锻 摹 隘 切 绑 孤 吠
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