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计算机组成原理第 4 章习题 第 4 章 存储器 例 4.1 设 CPU 有 16 根地址线，8 根数据线，并用MREQ 作访存控制信号（低电平有效），用WR 作读/写控制信号（高电平为读，低电平为写）。现有下列存储芯片：1K×4 位 RAM ；4K ×8 位 RAM ；8K ×8 位 RAM ；2K ×8 位 ROM ；4K ×8 位 ROM ；8K ×8 位 ROM 及 74LS138 译码器和 各种门电路，如图 4.1 所示。画出 CPU 与存储器的连接图，要求 G 1 Y7 G2A Y6 G G G , 为控制端 1 、 2A 、 2B G 2B