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低功耗高精度的电压比较器设计 design of a low power dissipation and high precision voltage comparator
Designa计ndand j|■‘
集成电路设gnCIlP与AApp应lica用tion绉广
doi：10．3969／j．issn．1003—353x．2011．01．017
低功耗高精度的电压比较器设计
赵海涛1，檀柏梅1，赵毅强2，耿俊峰2
(1．河北工业大学微电子研究所，天津300130；2．天津大学专用集成电路设计中心，天津300072)
摘要：设计了一款用于实现10位精度逐次逼近型模数转换器(SARADC)的电压比较器，
该比较器采用高速高精度比较器结构并进行了优化，在高速度、低功耗锁存器的基础上加预放大
级以提高比较精度，加RS触发器优化处理比较器的输出信号。同时，采用失调校准技术消除失
调，预放大级采用共源共栅结构抑制回程噪声，最终获得了高精度和较低的功耗。仿真结果表
0．35
明：在Chartered 2P4MCMOS工艺下，时钟频率5MHz，电源电压3．3V。分辨率达
trm
0．1mV，平均功耗约为0．45mW，芯片测试结果表明比较器满足了SARADC的要求。
关键词：低功耗；前置放大器；失调校准；锁存器；电压比较器
中图分类号：TN432文献标识码：A 文章编号：1003—353X(2011)Ol一0067—04
ofaLowPower and Precision
Design DissipationHigh VoltageComparator
Zhao
Haita01，Tan
Baimeil，ZhaoYiqian92，GengJunfen92
3001
(1．InstituteofMicroelectronics，HebeiUniversityofTechnology，Tia彬n30，China；
2．ASIC Center，Tianjin 300072，China)
Design University，Tianjin
Abstract：A for10bitsuccessive to
voltageeomparator approximationanalogdigitalconverter(SAR
ADC)was structureof and was inthe
presented．Theoptimization hiIghspeedhighprecisionadoptedproposed
onthe andlow was to
comparator．Basedhighspeed powerlatch，thepre-amplifier
stageemployedimprove
the andRSlatch was to the ofthis addition，the
precision stageappliedoptimizeoutputsignal comparator．In
offsetcanbecancelledout offset andthekickbacknoisewasretrainedcascade
by cancellation by circuit．
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