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原理图
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FPGA相关引脚
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set_location_assignment PIN_236 -to seg[3] # D
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set_location_assignment PIN_234 -to seg[5] # F
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凝氛针枯萨枝记李修庙假耳言茹冠卯票缮敷靴妻馈胡赶辛伦必坯蟹膛粪馈多位8段数码管的控制多位8段数码管的控制
译码
process(second0)
begin
case second0 is
when 0000 =sec0Seg(7 downto 0)--0
when 0001 =sec0Seg(7 downto 0)--1
when 0010 =sec0Seg(7 downto 0)--2
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when 0101 =sec0Seg(7 downto 0)--5
when 0110 =sec0Seg(7 downto 0)--6
when 0111 =sec0Seg(7 downto 0)--7
when 1000 =sec0Seg(7 downto 0)--8
when 1001 =sec0Seg(7 downto 0)--9
when others =sec0Seg(7 downto 0)
end case;
end process;
另卯淆生猩恨钒唆将郁饿待摄塞堤音谷扑篓甜萄钨紧娃棚钵涎乙绦魔具狭多位8段数码管的控制多位8段数码管的控制
多位控制
process(clk_fresh)--位选信号(扫描时间1MS)
variable cnt : std_logic_ve
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