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微机原理、汇编与接口技术;;;一、总线分类 1、按传送信息性质分 1）数据总线 2）地址总线 3）控制总线;;;;;数据与 低8位地址 分时复用;;; 分两种：一种8088组态有关的线，另一类是与组态无关的线 (1)MN/MX 控制8088工作与什么组态.接电源（+5V），8088处于最小组态，接地，8088处于最大组态 (2)最小组态下的控制信号线 IO/M 输入输出/存储器选择信号.输出低电平→访存；输出高电平→访问I/O端口 WR 写信号.低电平有效，在执行存储器或I/O端口的写操作时输出的一个选通信号 INTA 中断响应信号.低电平有效.是8088响应外部INTR而发出的中断响应信号;ALE 地址锁存允许信号. 是8088发出的选通脉冲，将AD7～AD0和A19/S6～A16/S3上出现的地址锁存到外部地址锁存器中 DT/R 数据发送/接收信号. 低电平→接收数据，高电平→发送数据 DEN 数据允许信号.低电平有效 SSO 系统状态输出信号.与IO/M、DT/R一起，反映8088所执行的操作 HOLD 保持请求信号.用于直接存储器存取操作，即DMA请求输入信号 HLDA 保持响应信号.DMA响应回答信号;(3)最大组态下的控制信号线 S2，S1，S0 3个状态信号. 其译码输出作为8088工作在最大组态时，对存储器和I/O端的口读/写操作信号. 3个状态信号与CPU所执行的操作见P177,表4-1 RQ/GT0、RQ/GT1 总线请求/允许信号. 双向，低电平有效. 两个外设同时发出总线请求时，RQ/GT0优先权高于RQ/GT1 LOCK 锁定信号.低电平有效.该信号由前缀指令LOCK使其有效；有效时，别的总线设备不能取得对系统3总线的控制权 QS0，QS1 队列状态信号.用于提供8088指令队列状态 ;(4)与组态无关的引线 RD 读选通信号.低电平时有效，表示正在进行存储器或I/O读操作 READY 准备就绪信号.是CPU寻址的存储器或I/O口送来的响应信号 TEST 测试信号.它是由WAIT指令测试的信号.低电平时，执行WAIT后面的指令；高电平时，CPU进入空转等待状态 INTR 中断请求信号.它是外设发来的可屏蔽中断请求信号，可由标志寄存器中的中断允许标志位来屏蔽 NMI 非屏蔽中断请求信号.它是边沿触发信号，是不可屏蔽的 RESET 复位信号;VCC 电源线.要求加5V±10%的电压 GND 地线.8086/8088有两条地线，这两条地线都要接地 CLK 时钟信号.一般由时钟信号发生器8284输出，它提供8088的定时操作.8088的标准时钟频率为5MHz ;4.2.2 8088的CPU系统和CPU总线;74LS373→8D锁存器，其引线排列和功能为：;2.双向总线驱动器;3.时钟发生器8284A ;8284A的框图;4.总线控制器8288 ; 命令信号 MRDC 存储器读命令.通知被选中单元，把数据发送到数据总线上 MWTC 存储器写命令.把数据线上的数据，写入被选中存储单元 IORC I/O读命令.通知被选中I/O口，把数据发送到数据总线上 IOWC I/O写命令.把数据线上的数据写入被选中I/O口 AMWC 存储器超前写.同MWTC，只是提前一个时钟脉冲 ; 总线控制信号 DT/R 数据发送/接收信号 DEN 数据允许信号 MCE/PDEN 设备级联允许/外部数据允许信号 ALE 地址锁存信号;5.最小组态下的8088CPU系统 ; A19～A16，A7～A0为分时复用线，必须用地址锁存器74LS373或8282把这12位地址锁存.A15～A8不用锁存.在此全部锁存 数据线可加双向驱动器，也可直接输出（小系统）.用8088的数据允许信号DEN接245的OE， 8088的的收发控制DT/R接245的DIR 8088的控制线可直接作系统 控制总线，RD、WR和IO/M经组 合形成存储器读/写信号和 I/O读/写信号.组合逻辑电路 如右图所示： ;6.最大组态下的8088CPU系统 ;1.指令周期、总线周期和T状态 计算机是在程序控制下工作的，每条指令的执行，都要经过取指，译码，执行三个阶段，这些操作都是在时钟脉冲CLK的统一控制下一步一步进行的，它们都需要一定的时间; T状态→CPU处理动作的最小单位，即一个时钟周期. 如：8088的时钟频率为5MHz，故时钟周期或1个T状态为200ns 指令周期→执行一条指令所需要的时间. 8088中不同指令的指令周期是不等长的.最短2个时钟周期，最长200个时钟周期（如：16位乘除法指令） 总线周期→把指令周期划分为一个个总线周期.基本的总线周期有存储器读/写、I/O端口读/写和中断