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VHDL主要描述语句――CASE语句课件
VHDL主要描述语句――CASE语句;2.试修改如下程序中出现的错误并分析其可以实现的功能.;二、新授;三、例题(试分析如下程序可以实现什么功能);对比总结:以上两个程序表明,一些功能相同的描述,可以用IF语句实现,也可以用
CASE语句实现.但是两者还是有区别的.首先,在IF语句中,先处理最起始
的条件,如果不满足才会处理下一个条件.而在CASE语句中,没有值的顺
序号,所有的值是并行处理的.因此WHEN项中已用过的值,如果在后面
WHEN项中再次使用,那在语法上错误的.也就是说,表达式的值不能重
复使用.如下列程序:
CASE SEL IS
WHEN 0 = Q = I1 ;
WHEN 1 TO 3 = Q = I1 ;
WHEN 2 TO 5 = Q = I2 ;
WHEN 5 TO 7 = Q = I3 ;
WHEN OTHER = Q = I4 ;
END CASE ;
;四、练习(用CASE 语句设计一个四选一数据选择器);LIBRARY IEEE;
USE IEEE.STD-LOGIC-1164.ALL;
ENTITY 4SEL IS
PORT ( I0,I1,I2,I3: IN STD-LOGIC ;
A,B:IN STD-LOGIC ;
Q:OUT STD-LOGIC ) ;
END 4SEL ;
ARCHITECTURE A OF 4SEL IS
SIGNAL D : STD-LOGIC-VECTOR(2 DOWNTO 0);
D=A B ;
PROCESS( D )
END A;
;五、思考题
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