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- 2017-08-25 发布于河南
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Verilog第五讲状态机设计及其指导原则(P)
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第五讲状态机设计及其指导原则 状态机是一种设计思想方法
1 状态机是一种设计思想方法
2 状态机结构
3 状态机设计的其他技巧
4 状态机设计步骤
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状态机的本质--对具有逻辑顺序或
时序规律事件的一种描述方法
状态机的两个应用思路:
- 从状态变量入手
- 明确电路的输出的关系
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总结:
状态机结构
对于逻辑电路而言,小到一个简单的时
序逻辑,大到复杂的微处理器,都适合用状 摩尔(MOORE)状态机
态机方法进行描述。不要仅仅局限于时序逻 - 输出只是当前状态值的函数,并且仅在时钟边沿到
辑,发现电路的内在规律,确认电路的“ 状态 来时才发生变化
变量” ,大胆使用状态机描述电路模型。由于
状态机不仅仅是一种电路描述工具,它更是 米立(MEALY)状态机
一种思想方法,而且状态机的HDL语言表达 - 输出则是当前状态值、当前输出值和当前输入值的
方式比较规范,有章可循,所以很多有经验 函数
的设计者习惯用状态机思想进行逻辑设计,
对各种复杂设计都套用状态机的设计理念, 注:这两种状态机都是同步的时序电路
从而提高设计的效率和稳定性。
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Moore 状态机 Mealy 状态机
下一个状态 = F(当前状态,输入信号); 下一个状态 = F(当前状态,输入信号);
输出信号 = G(当前状态); 输出信号 = G(当前状态,输入信号);
时序逻辑
组合逻辑 时序逻辑 组合逻辑
组合逻辑 组合逻辑
输入
输入
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