- 1、本文档共10页,可阅读全部内容。
- 2、原创力文档(book118)网站文档一经付费(服务费),不意味着购买了该文档的版权,仅供个人/单位学习、研究之用,不得用于商业用途,未经授权,严禁复制、发行、汇编、翻译或者网络传播等,侵权必究。
- 3、本站所有内容均由合作方或网友上传,本站不对文档的完整性、权威性及其观点立场正确性做任何保证或承诺!文档内容仅供研究参考,付费前请自行鉴别。如您付费,意味着您自己接受本站规则且自行承担风险,本站不退款、不进行额外附加服务;查看《如何避免下载的几个坑》。如果您已付费下载过本站文档,您可以点击 这里二次下载。
- 4、如文档侵犯商业秘密、侵犯著作权、侵犯人身权等,请点击“版权申诉”(推荐),也可以打举报电话:400-050-0827(电话支持时间:9:00-18:30)。
- 5、该文档为VIP文档,如果想要下载,成为VIP会员后,下载免费。
- 6、成为VIP后,下载本文档将扣除1次下载权益。下载后,不支持退款、换文档。如有疑问请联系我们。
- 7、成为VIP后,您将拥有八大权益,权益包括:VIP文档下载权益、阅读免打扰、文档格式转换、高级专利检索、专属身份标志、高级客服、多端互通、版权登记。
- 8、VIP文档为合作方或网友上传,每下载1次, 网站将根据用户上传文档的质量评分、类型等,对文档贡献者给予高额补贴、流量扶持。如果你也想贡献VIP文档。上传文档
查看更多
电子学课程设计报告有符号5位整数乘法器设计及制作
哈尔滨工业大学(威海) 电子学课程设计报告 有符号5位整数乘法器设计与制作
姓名: 班级: 学号: 指导教师:
一 设计指导
电子学课程设计
(1)课程设计的性质、目的和任务
创新精神和实践能力二者之中,实践能力是基础和根本。这是由于创新基于实践、源于实践,实践出真知,实践检验真理。实践活动是创新的源泉,也是人才成长的必由之路。
通过课程设计的锻炼,要求学生掌握电路的一般设计方法,具备初步的独立设计能力提高综合运用所学的理论知识独立分析和解决问题的能力进一步掌握电子仪器的正确使用方法掌握。二 设计要求
三 设计思路
四 模块具体设计
1.输入模块
以data[4..0](即程序中的a[4..0])作为数据输入端口,利用mul(乘号)的高低电平来控制依次输入被乘数与乘数,由于符号运算不同于数字运算,且涉及led显示,故选择了符号与数字的分别输出。当mul=0时,输入被乘数,即乘号输入前将被乘数写入;mul=1时,输入乘数。其中使用了寄存器,故引入了clk时钟信号。
Ahdl具体程序如下subdesign shuru
(
clk,mul,a[4..0]:input;
b[3..0],c[3..0]:output;
fu1,fu2:output;
)
variable cheng[3..0]:dff;
bcheng[3..0]:dff;
d:dff;
begin
cheng[].clk=clk;
bcheng[].clk=clk;
d.clk=clk;
if mul==b0 then
bcheng[].d=a[3..0];d.d=a[4];
else bcheng[].d=bcheng[].q;d.d=d.q;fu2=a[4];cheng[].d=a[3..0];
end if;
b[]=bcheng[].q;
c[]=cheng[].q;
fu1=d.q;
end;
波形图如下:以15*(-3)为例
模块如下:
2.led显示模块
将输入模块的输出进行整合输出给led等进行显示,灯亮表示1,灯灭表示0。同时让不使用的led灯不亮Ahdl具体程序如下:
subdesign ledxianshi
(
a[3..0],b[3..0]:input;
afu,bfu:input;
c[7..0],d[7..0]:output;
)
begin
c[]=c[4]=not afu;c[3]=not a[3];c[2]=not a[2];c[1]=not a[1];c[0]=not a[0];
d[]=d[4]=not bfu;d[3]=not b[3];d[2]=not b[2];d[1]=not b[1];d[0]=not b[0];
end;
波形图如下:以15*(-3)为例
模块如下:
3.乘法模块
具体计算用普通乘法乘数每一位分别与被乘数相乘再相加的方法,符号运算使用异或,利用mul(即*)和equal(即=)的高低电平控制输出。乘号和等号都为低时输出被乘数在数码管显示,乘号为高等号为低时输出乘数在数码管显示,等号为高时输出乘积在数码管显示。输出都用9位二进制数,第1-8位为数字,第九位是符号。
Ahdl具体程序如下:
subdesign chengfa
(
shufu1,shufu2,mul,equal,b[3..0],c[3..0]:input;
g[8..0]:output;
)
variable x1[7..0],x2[7..0],x3[7..0],x4[7..0]:node;
begin
x1[]=
x2[]=
x3[]=
x4[]=
x1[3..0]=b[]c[0];
x2[4..1]=b[]c[1];
x3[5..2]=b[]c[2];
x4[6..3]=b[]c[3];
if equal==b1 then
g[7..0]=x1[]+x2[]+x3[]+x4[];g[8]=shufu1 xor shufu2;
elsif mul==b0 then g[7..0]=g[3..0]=b[3..0];g[8]=shufu1;
else g[7..0]=g[3..0]=c[3..0];g[8]=shufu2;end if;
end;
波形图如下:以15*(-3)为例
模块如下:
4.转换模块
Ahdl具体程序如下:
subdesign zhuanhuan2
(
fa[8..0]:input;
clk1:input;
fuh[7..0]:output;
ge[3..0]:output
您可能关注的文档
最近下载
- 《复合材料的特性与应用》课件.ppt
- 妊娠晚期促子宫颈成熟与引产指南(2024)解读.pptx
- 保险异议处理拒绝处理ppt保险异议处理.ppt VIP
- 2025年内蒙古自治区中考数学试题卷(含答案解析).docx
- 湖南省永州市祁阳市2022-2023学年三年级下学期期末语文试题(pdf版无答案).docx VIP
- 设计和开发过程控制培训.pptx VIP
- 2019中国国内旅游发展年度报告_25页_4mb.pdf VIP
- 人教版三年级上册数学全册教学设计(配2025年秋新版教材).docx
- 安全风险分级管控和隐患排查治理双重预防机制培训课件.pptx VIP
- 各专业文件准备目录--内分泌科药物临床试验机构GCP SOP.doc VIP
文档评论(0)