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时序逻辑路习题解答
自我测验题
1.图T4.1所示为由或非门构成的基本SR锁存器,输入S、R的约束条件是 。
A.SR=0 B.SR=1 C.S+R=0 D.S+R=1
图T4.1 图T4.2
2.图T4.2所示为由与非门组成的基本SR锁存器,为使锁存器处于“置1”状态,其应为 。
A.=00 B.=01 C.=10 D.=11
3.SR锁存器电路如图T4.3所示,已知X、Y波形,判断Q的波形应为A、B、C、D中的 B 。假定锁存器的初始状态为0。
(a) (b)
图T4.3
Qn=0,要求Qn+1=0,则应使 。
A.J=×,K=0 B.J=0,K=× C.J=1,K=× D.J=K=1
6.电路如图T4.6所示。实现的电路是 。
A. B. C. D.
图T4.6
7.电路如图T4.7所示。实现的电路是 。
A. B. C. D.
图T4.7
8.电路如图T4.8所示。输出端Q所得波形的频率为CP信号二分频的电路为 。
A. B. C. D.将D触发器改造成T触发器,所示电路中的虚线框内应是。
图T4.9
A.门 B.门 C.门 D.门n B.2n C.n2 D.2 n
14.一个5位的二进制加计数器,由00000状态开始,经过75个时钟脉冲后,此计数器的状态为 :
A.01011 B.01100 C.01010 D.00111
15.图示为某的图,由此可判定该十进制计数进制计数四进制计数八进制计数
图T4.15
16.电路如图T4.16所示,假设电路中各触发器的当前状态Q2 Q1 Q0为100,请问在时钟作用下,触发器下一状态Q2 Q1 Q0为 。
图T4.16
A.101 B. 100 C. 011 D. 000
17.电路图T4.17所示。设电路中各触发器当前状态Q2 Q1 Q0为110,请问时钟CP作用下,触发器下一状态为 。
图T4.17
A. 101 B.010 C.110 D.111
18.电路如图T4.18所示, 74LS191具有异步置数
图T4.18
A. 1100 B. 1011 C. 1101 D. 0000
表T4.18 74LS191功能表
CP D0 D1 D2 D3 Q0 Q1 Q2 Q3 0 × × × d0 d1 d2 d3 d0 d1 d2 d3 1 0 0 ↑ × × × × 加 法 计 数 1 0 1 ↑ × × × × 减 法 计 数 1 1 × × × × × × 保 持 19.下列功能的触发器中, 不能构成移位寄存器。
A.SR触发器 B.JK触发器 C.D触发器 D.T和T'触发器。
20.图T4.20所示电路的功能为 。
图T4.22
A.并行寄存器 B.移位寄存器 C.计数器 D.序列信号发生器
21.4位移位寄存器,现态为1100,经左移1位后其次态为 。
22.现欲将一个数据串延时4个CP的时间,则最简单的办法采用 。
kHz,经过
可转换为4位并行数据输出。
A.8ms B.4ms C.8μs D.4μs
24.由3级触发器构成的环形和扭环形计数器的计数模值依次为 。
A.8和8 B.6和3 C.6和8 D.3和6
习 题
1.由或非门构成的基本SR锁存器如图所示,已知输入端、的电压波形,试画出与之对应的Q和的波形。
图P4.1
解:
2.由与非门构成的基本SR锁存器如图P4.所示、的电压波形,试画出与之对应的Q和的波形。
图P4.2
解:
3.已知双门锁存器如图P4.
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