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lijianyi@ zhlljy@ ——物理地址的形成 ——物理地址的形成 8086CPU的外部引脚 主要需解决： 地址与数据的分离 地址锁存 电路实现方案 用3片8位的锁存器8282实现地址锁存。ALE为锁存控制信号，OE#≡0使锁存的地址直接输出； 用1片双向三态门8286用作数据总线驱动和隔离，DT/R#作为方向控制，DEN#作为开门信号； 其他控制信号由8088直接产生。 大多数控制信号是由总线控制器8288对S0#、S1#、S2#三个信号译码得到，如DT/R#、ALE、DEN#、IOR#、IOW#、MEMR#、MEMW#信号。DB和AB的构成基本同最小模式。 PC/XT机的总线采用了最大模式，但有三点区别： 地址总线驱动用2个74LS373和1个74LS244代替3个8282； 数据总线驱动用74LS245代替8286； 支持DMA传送。 8086 CPU的两种工作模式 (1)最小组态 (1)最小组态 (1)最小组态 (1)最小组态 (2)最大组态 (2)最大组态 (2)最大组态 (2)最大组态 (2)最大组态 (2)最大组态 2．8086CPU的引线 2．8086CPU的引线 2．8086CPU的引线 2．8086CPU的引线 2．8086CPU的引线 2．8086CPU的引线 80486的工作方式 Pentium微处理器的内部结构 2.6.1 Pentium微处理器 2.6.2 P6结构微处理器 2.6.3 Pentium IV微处理器 2.6 Pentium系列微处理器 2.6.1 Pentium微处理器 1. Pentium微处理器的内部结构 超标量流水线 内部高速缓存 总线部件 ——超标量与流水线 超标量和流水线的概念 超标量：配置多个执行部件和指令译码电路，能同时执行多条指令。 Pentium的三个执行单元组织：一个执行浮点指令，另两个执行整型指令（U流水线和V流水线） ——Pentium同时可以执行三条指令 ——80586的指令五个操作步骤 0 1 2 3 4 5 6 8 7 时间 i1 PF D1 D2 EX WB PF D1 D2 EX WB PF D1 D2 EX WB PF D1 D2 EX WB i2 i3 i4 ——整数流水线 PF(指令预取)： 处理器从代码cache中预取指令。 D1(译码阶段)： 处理器对指令译码确定操作码和寻址信 息。在这个阶段还进行指令的成对性检查 和分支预测。 D2(地址生成)： 产生访问存储器的地址 EX(指令执行)： 处理器或者访问数据cache，或者利用ALU、 筒型移位器或其他功能单元计算结果。 WB(指令写回)：利用指令运行结果更新寄存器和标志寄存器 五个阶段的整数流水线： 时间 i1 PF D1 D2 EX WB PF D1 D2 EX WB PF D1 D2 EX WB PF D1 D2 EX WB i2 i3 i4 0 1 2 3 4 5 6 8 7 PF D1 D2 EX WB PF D1 D2 EX WB PF D1 D2 EX WB PF D1 D2 EX WB i5 i6 i7 i8 U V U V U V U V ——Pentium的超标量流水线 ——指令配对 两条指令都是简单指令 没有写后读和写后写的依赖关系 一条指令不能同时既包含位移量又包含立即数 带前缀的指令只能出现在U流水线中 U、V两条流水线并行执行的要满足一些前提条件，Pentium数据手册定义的配对规则： 2. Pentium微处理器的寄存器 标志寄存器 控制寄存器组 模型专业寄存器 与80486寄存器相比不同之处： 控制寄存器组 MCE：机器检查有效。 PSE：页面尺寸扩展。 DE：调试扩展。 TSD：时间/日期标记禁用。 PVI：保护模式虚拟中断。 VME：虚拟8086模式扩展。 模型专业寄存器 3. Pentium微处理器的操作模式 实模式——与80486相同 保护模式 系统管理模式 与80486寄存器相比不同之处： 4. Pentium MMX微处理器的操作模式 单指令多数据执行模式 增加新数据类型 MMX寄存器 57条MMX指令 2.6.2 P6结构微处理器 1. Pentium Pro 微处理器 3条超标量流水线 3个并行寄存器 5个执行单元 2个一级8KB 高速缓存 1个二级 高速缓存 36条地址线 2.3.1 80286CPU的主要性能 2.3.2 80286CPU的功能结构 2.3.3 80286CPU的寄存器 2.3.4 80286CPU的存储器寻址 2.3 802