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! 34 ! 2 # 东南大学学报(自然科学版) VOI. 34 NO. 2
2004 $ 3 % JOURNAL OF SOUTHEAST UNIVERSITY (NaturaI Science EditiOn ) Mar. 2004
基于PHEMT 工艺的5 GHZ 锁相环芯片
程树东 郁炜嘉 朱 恩 王雪艳 沈 祯 王志功
( , 210096 )
东南大学射频与光电集成电路研究所 南京
摘要:给出了基于0. 2 !m 砷化镓赝晶高电子迁移率器件工艺设计的高速锁相环芯片的电路结
构、性能分析与测试结果. 芯片采用吉尔伯特结构的鉴相器和交叉耦合负阻差分环形压控振荡
器,总面积为1. 15 mm X 0. 75 mm. 锁定时中心工作频率为4. 44 GHZ ,锁定范围约为360 MHZ ,在
100 kHZ 频偏处的单边带相位噪声约- 107 dBc / HZ ,经适当修改后可应用于光纤通信系统中的时
钟数据恢复电路.
关键词:锁相环;鉴相器;压控振荡器;砷化镓赝晶高电子迁移率器件工艺
中图分类号:TN911. 8 文献标识码:A 文章编号:1001 - 0505(2004 )02-0157-04
5 Ghz PLL chip using PhEMT technology
Cheng Shudong Yu Weijia Zhu En Wang Xueyan Shen Zhen Wang Zhigong
-
(Institute of RF OE ICs,ICs, SoutheastSoutheast University,University, NanjingNanjing 210096,210096, China)China)
ICs,ICs, SoutheastSoutheast University,University, NanjingNanjing 210096,210096, China)China)
-
Abstract: a 5 GHZ phase locked loop (PLL) chip based on 0.2 !m Gaas PHEMT (pseudomorphic
- -
high electron mobility transistor) technology has been realiZed and characteriZed. The chip siZe is
1.15 mm X 0.75 mm With a phase detector using Gilbert cell and a differential ring voltage controlled
-
oscillator(VCO) using cross coupled negative resistance. The locking range is approximately 360
MHZ With a center freguency of 4.44 GHZ and the phase noise is - /
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