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第四章 触发器;4.1 概 述;为了实现记忆1位二值信号的功能，触发器必须具有如下几个基本特点：;触发器的分类;4.2 触发器的电路结构与动作特点;工作原理;0;1;0;特性表（真值表）;基本RS触发器的特点;图4.2.1 用或非门组成的基本RS触发器（a）、（b）电路结构（c）图形符号;图4.2.2 用与非门组成的基本RS触发器（a）电路结构 （b）图形符号;二、动 作 特 点;图4.2.3 例4.2.1的电路和电压波形（a）电路结构 （b）电压波形图;4.2.2 同步RS触发器的电路结构与动作特点;图4.2.4 同步RS 触发器（a）电路结构（b）图形符号;逻辑电路;R;CP=1时， S′=S， R′= R，Q的状态由R、S决定。 如下表所示：;S;特性表;次态Qn+1的卡诺图;状态转换图;图4.3.1 RS 触发器的状态转换图;波形图;基本RS触发器的翻转由输入信号控制； 同步RS触发器的翻转由时钟脉冲控制，属于电平触发，即在CP=1期间都可以触发翻转； CP=1期间，若R、S有多次变化，Q也会多次翻转，即会“空翻”。 时钟电平控制。在CP＝1期间接收输入信号，CP＝0时状态保持不变，与基本RS触发器相比，对触发器状态的转变增加了时间控制。 R、S之间有约束。不能允许出现R和S同时为1的情况，否则会使触发器处于不确定的状态。 ;波形图;二、动 作 特 点 ;波 形 图;波形图;图4.2.5 带异步置位、复位端的同步RS触发器（a）电路结构 （b）图形符号;图4.2.6 例4.2.2 的电压波形图;图4.2.7 D 型锁存器电路（a）基本形式 （b）7475采用的电路;1、主从RS触发器;0;逻辑符号;2、主从JK触发器;特性表;电路特点;带清零端和预置端的主从JK触发器;带清零端和预置端的主从JK触发器的逻辑符号;集成主从JK触发器;与输入主从JK触发器的逻辑符号;图4.2.8 主从结构RS触发器（a）电路结构 （b）图形符号;图4.2.9 例4.2.3 的电压波形图;二、主从触发器的动作特点 ;主从JK触发器的一次变化现象 ;主从JK触发器的波形图 ;图4.2.10 主从 J K 触发器;图4.2.11 具有多输入端的主从 J K 触发器;图4.2.12 例4.2.4 的电压波形图;图4.2.13 例4.2.5 的电压波形图;4.2.4 边沿触发器的电路结构和动作特点 ;图4.2.14 利用CMOS传输门的边沿触发器;图4.2.15 带异步置位、复位端的CMOS边沿触发器;二、维持阻塞触发器 边沿触发器的另一种电路结构形式是维持阻塞结构。在TTL电路中这种结构形式用得比较多。 下图就是维持阻塞结构RS触发器的电路结构图：;图4.2.16 维持阻塞结构的 R S 触发器;图4.2.17 维持阻塞结构的D触发器;图4.2.18 具有异步置位、复位端和多输入 端的维持阻塞D触发器;维持阻塞D边沿触发器 ;工作原理;D触发器的功能表 ;利用传输延迟时间的边沿触发器(a)电路结构 (b)逻辑符号;工作原理;四、边沿触发器的动作特点 ;边沿D触发器的波形图 ;边沿JK触发器的波形图 ;图4.2.19 利用传输延迟时间的边沿触发器;图4.2.20 例4.2.6 的电压波形图;附：边沿触发器;下降沿时刻有效;逻辑符号;集成边沿D触发器;2、边沿JK触发器;边沿JK触发器的逻辑符号;集成边沿JK触发器;4.3触发器的逻辑功能及其描述方法;4.3.1 触发器按逻辑功能的分类 ;特性表（真值表）;特性表;次态Qn+1的卡诺图;状态转换图;图4.3.1 RS 触发器的状态转换图;波形图;集成基本RS触发器;JK触发器的功能表 ;JK触发器特性方程和状态转换图;图4.3.2 JK触发器的状态转换图;T触发器功能表 ;T触发器特性方程和状态转换图;图4.3.3 T 触发器的状态转换图和逻辑符号;D触发器的功能表 ;D触发器特性方程和状态转换图;图4.3.4 D 触发器的状态转换图;集成同步D触发器;4.3.2 触发器的电路结构与逻辑功能的关系;集成维持阻塞D触发器 ;集成负边沿JK触发器 ;图4.3.5 维持阻塞结构 JK 触发器（74LS109）的电路图;图4.3.6 利用CMOS传输门的JK 触发器CC4027;图4.3.7 将JK 触发器用作RS、T 触发器（a）用作RS触发器 （b）用作T 触发器;JK触发器转换为D、T触发器;D触发器转换为JK触发器