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第10章 输入输出(I/O)系统 10.1 输入输出(I/O)系统概述 10.2 程序中断输入输出方式 10.3 DMA输入输出方式 10.4 通道控制方式和外围处理机方式 10.5 总线结构 10.6 外设接口 学习目的 1.掌握I/O与主机交换信息的三种控制方式及其相应的接口功能和组成。 2.掌握总线控制逻辑，要求学生能对系统总线在计算机硬件结构中的地位和作用有所了解。 3.了解I/O接口的功能和基本结构、I/O端口及其编址。 重难点 1. I/O与主机交换信息的三种控制方式及其相应的接口功能和组成。 2.总线仲裁方式和总线的定时方式。 输入输出系统包括: (1)外部设备 (2)设备控制器(设备适配器或接口)，其作用是控制并实现主机与外部设备之间的数据传送。 CPU对I/O设备的寻址方法： (1)专设I/O指令。 如指令IN完成输入，指令OUT完成输出操作。指令的地址码字段指出输入输出设备的设备代码。 (2)利用访存(取数/存数)指令完成I/O功能。 表10.1 输入输出地址分配表 (1) 实现主机和外围设备之间的数据传送控制。 (2) 实现数据缓冲，以达到主机同外围设备之间的速度匹配。 (3) 接受主机的命令，提供设备接口的状态，并按照主机的命令控制设备。 1.按照数据传送的宽度可分为： （1）并行接口：设备和接口是将一个字节(或字)的所有位同时传送 （2）串行接口：设备和接口间的数据是一位一位串行传送的，而接口和主机之间是按字节或字并行传送。接口要完成数据格式的串—并变换。 2. 按照数据传送的控制方式可分成 （1）程序控制输入输出接口 （2）程序中断输入输出接口 （3）直接存储器存取(DMA)接口 1.程序直接控制(programed direct control)方式： 完全通过程序来控制主机和外围设备之间的信息传送。 2.程序中断传送(program interrupt transfer)方式 3.直接存储器存取(direct memory access,简称DMA)方式：在外围设备和主存之间开辟直接的数据传送通路。 4. I/O通道控制(I/O channel control)方式 5. 外围处理机方式（输入输出处理机）(peripheral processor unit,简称PPU) 图10.1 输入输出系统的结构(具有CH或I/O处理机) 1. 中断的作用： (1) CPU与I/O设备并行工作 (2) 硬件故障处理 (3) 实现人机联系 (4) 实现多道程序和分时操作 (5) 实现实时处理 (6) 实现应用程序和操作系统(管态程序)的联系： “Trap”指令（“软中断”） (7) 多处理机系统各处理机间的联系 2. 有关中断的产生和响应的概念 中断源：引起中断的事件，即发出中断请求的来源。 ① 中断源的种类： 外中断：I/O设备、定时钟等来自处理机外部 设备的中断。 内中断：处理器硬件故障或程序“出错”引起的中断。 软中断：由“Trap”指令产生的中断，这是在程序中预先安排好的。 ② 中断触发器： 当中断源发生引起中断的事件时，先将它保存在设备控制器的“中断触发器”中，即将“中断触发器”置“1”。当中断触发器为“1”时，向CPU发出“中断请求”信号。每个中断源有一个中断触发器。全机的多个中断触发器构成中断寄存器。其内容称为中断字或中断码。CPU进行中断处理时，根据中断字确定中断源，转入相应的服务程序。 (2) 中断的分级与中断优先权 优先权：有多个中断同时发生时，对各个中断响应的优先次序。 当中断源数量很多时，中断字就会很长；同时也由于软件处理的方便，一般把所有中断按不同的类别分为若干级，称为中断级，在同一级中还可以有多个中断源。首先按中断级确定优先次序，然后在同一级内再确定各个中断源的优先权。 （注意：当对设备分配优先权时，必须考虑数据的传输率和服务程序的要求。 ） (3) 禁止中断和中断屏蔽 ① 禁止中断 禁止中断：产生中断源后，由于某种条件的存在，CPU不能中止现行程序的执行。 “中断允许”触发器，该触发器为“1”状态时允许中断，为“0”时禁止中断。 “中断允许”触发器通过“开中断”或“关中断”指令来置位、复位。进入中断服务程序后自动“关中断”。 ② 中断屏蔽：当产生中断请求后，用程序方式有选择地封锁部分中断，而允许其余部分中断仍得到响应。 实现方法：为每个中断源设置一个中断屏蔽触发器来屏蔽该设备的中断请求。具体说，用程序方法将该触发器置“1”，则对应的设备中断被封锁，若将其置“0”，才允许该设备的中断请求得到响应。由各设备的中断屏蔽触发器组成中断屏蔽寄存器。 中断又分为可屏蔽中断和