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第2章2-2-5十进加法器
计 算 机 组 成 原 理 计 算 机 系 统 概 论 首页 2章 * 2.2.4 基本的二进制加法 / 减法器 FA FA FA FA S0 S1 Sn-2 Sn-1 C1 C2 Cn-2 Cn-1 Cn 溢出 An-2 An-1 A2 A1 Bn -1 Bn-2 B2 B1 M=0加M=1减 C0 方式控制 M 上图显示了补码运算的二进制加法减法器逻辑结构图。由图可以看到n个1位的全加器(FA)可联级成一个n位的行波进位加减器。 M为方式控制输入线,当M=0时,做加法(A+B)运算;当M=1时,做减法(A - B)运算。在后一种情况下, A-B运算转化成[A]补+ [- B]补运算,求补过程由B + 1 来实现。 想看全加器(FA)的示意图请点击此图标, 即在下面几张中。 + Xi1 Yi1 + Xi2 Yi2 + Xi3 Yi3 + Xi0 Yi0 + + + + Si1 Si2 Si3 Si0 0 Ci+1 S’i3 C’i+1 S’i2 S’i1 S’i0 Ci 一位BCD加法器单元逻辑结构 二进制加法 十进制调整 2.2.5 十进加法器
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