(精选)专用集成电路设计实践(西电版)第3章 电路设计课件.ppt

第3章　电路设计 ; 3.1　触发器的设计3.1.1　触发器的原理　　触发器是时序逻辑电路的最基本单元,在时序逻辑领域内占有相当重要的地位,它被作为基本记忆单元广泛应用于各种时序逻辑系统中。触发器包括单稳态触发器和双稳态触发器。我们把输出的电平有一个稳态和一个暂稳态的触发器称为单稳态触发器,而把输出电平为两个稳态的触发器称为双稳态触发器。触发器的种类很多,但所有的双稳态触发器都应具有以下特性: ;　　(1)有两个互补的输出Q和Q,即当Q=0时,Q=1,而当Q=1时,Q=0。　　(2)有两个稳定状态。若输入不发生变化,触发器必定处于其中某一个稳定状态并且可以长期保持下去。一般当Q=0和Q=1时称触发器处于0态,而当Q=1和Q=0时称触发器处于1态。 ;　　(3)在输入信号的作用下,双稳态触发器可从一个稳定状态转换到另一个稳定状态,并继续稳定下去,直到下一次输入发生变化时,才可能再次改变状态。　　我们把输入信号没有发生变化直到输入信号发生变化之前的触发器状态称为电路的现在状态,用Qn和Qn来表示,而把输入信号发生变化后触发器所进入的状态称为它的下一态,用Qn+1和Qn+1表示。若用X来表示输入信号的集合,则触发器的下一状态是它的现在状态和输入信号的函数,即 ;3.1.2　触发器的指标 　　1.建立时间　　建立时间是指在触发器的时钟信号上升沿到来以前,数据稳定不变的