集成电路封装和可靠性Chapter5_未来封装技术展望.pdfVIP

集成电路封装和可靠性Chapter5_未来封装技术展望.pdf

  1. 1、原创力文档(book118)网站文档一经付费(服务费),不意味着购买了该文档的版权,仅供个人/单位学习、研究之用,不得用于商业用途,未经授权,严禁复制、发行、汇编、翻译或者网络传播等,侵权必究。。
  2. 2、本站所有内容均由合作方或网友上传,本站不对文档的完整性、权威性及其观点立场正确性做任何保证或承诺!文档内容仅供研究参考,付费前请自行鉴别。如您付费,意味着您自己接受本站规则且自行承担风险,本站不退款、不进行额外附加服务;查看《如何避免下载的几个坑》。如果您已付费下载过本站文档,您可以点击 这里二次下载
  3. 3、如文档侵犯商业秘密、侵犯著作权、侵犯人身权等,请点击“版权申诉”(推荐),也可以打举报电话:400-050-0827(电话支持时间:9:00-18:30)。
  4. 4、该文档为VIP文档,如果想要下载,成为VIP会员后,下载免费。
  5. 5、成为VIP后,下载本文档将扣除1次下载权益。下载后,不支持退款、换文档。如有疑问请联系我们
  6. 6、成为VIP后,您将拥有八大权益,权益包括:VIP文档下载权益、阅读免打扰、文档格式转换、高级专利检索、专属身份标志、高级客服、多端互通、版权登记。
  7. 7、VIP文档为合作方或网友上传,每下载1次, 网站将根据用户上传文档的质量评分、类型等,对文档贡献者给予高额补贴、流量扶持。如果你也想贡献VIP文档。上传文档
查看更多
集成电路封装测试与可靠性 Chapter 5 Trends of Microelectronic Packaging 未来封装技术展望 NingNing NingNing ((宁宁宁宁)) UESTC- Ning Ning 2014-10-10 1 集成电路封装测试与可靠性 Outline Introduction Direct Chip Attach (DCA) 三维(3D)封装技术 无源元件的集成化 Wafer Level Packaging (WLP ) SoC / SiP / SOP UESTC- Ning Ning 2014-10-10 2 集成电路封装测试与可靠性 Introduction UESTC- Ning Ning 2014-10-10 3 集成电路封装测试与可靠性 Introduction UESTC- Ning Ning 2014-10-10 4 集成电路封装测试与可靠性 Introduction  微电子封装的要求 具有的I/O数更多; 更好的电性能和热性能; 更小、更轻、更薄,封装密度更高; 更便于安装、使用和返修; 可靠性更高; 性能价格比更高。 UESTC- Ning Ning 2014-10-10 5 集成电路封装测试与可靠性 微电子封装的总趋势  由有封装向少封装和无封装发展  2D封装 3D封装发展  无源元件集成化,目前有源元件与无源元件比例为1/10~1/50;  传统的三级封装 (Level 1/2/3 ) 单一封装层次:单级集成模块(SLIM) UESTC- Ning Ning 2014-10-10 6 集成电路封装测试与可靠性 Direct Chip Attach (DCA) 基板上芯片直接安装  DCA(特别FCB技术)将成为微电子封装主流形式。  DCA技术的优越性:  DCA可实现最小的封装,接近无封装(亦称零级封装) ;  通常封装(如SOP、QFP) :芯片、WB 、LeadFrame和基板, 共有三个界面和一个互连层;而FC只有芯片-基板一个界 面和一个互连层。失效焊点更少,可靠性更高

文档评论(0)

nuvem + 关注
实名认证
文档贡献者

该用户很懒,什么也没介绍

1亿VIP精品文档

相关文档