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实验二 Quartus 原理图设计 实验目的及要求 QuartusII是Altera公司的综合性PLD开发软件，支持原理图、VHDL、Verilog HDL以及AHDL等多种设计输入形式，内嵌自有的综合器及仿真器，可以完成从设计输入到硬件配置的完整PLD设计流程。通过本课了解QuartusII软件的基本操作，学会如何创建工程，学会原理图的输入及编译，用软件进行仿真。尝试VHDL的初步设计。 1位全加器原理图输入设计： 设计与实验方法参考第1章 实验原理 1）原理图 2）实验步骤 1、创建新工程 打开QuartusII软件，在主界面中执行File-New Project Wizard…QuartusII会启动新建工程向导。向导的第一页用以设置工程文件夹、工程名称以及顶层实体名称。可以仅在Family栏中选择合适的器件系列，由QuartusII自动选择。点击Next按钮进入EDA工具设置页面，用以设置第三方综合器、仿真器和时序分析工具，默认值为不是用第三方EDA工具。在新工程向导的最后一步，QuartusII会给出新建工程的摘要信息，点击Finish按钮即可完成向导。 2.原理图输入 打开工程，在QuartusII界面中执行File-New…菜单命令打开新建对话框，选中Device Design Files选项卡中的Block Diagram/Schematic File后，点击O