测控在系统编程数字时钟.docVIP

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测控在系统编程数字时钟

显示模块程序 library ieee; use ieee.std_logic_1164.all; entity DISPLAY is port(d:in std_logic_vector(3 downto 0); q:out std_logic_vector(6 downto 0)); end DISPLAY; architecture disp_are of DISPLAY is begin process(d) begin case d is when0000 =q=0111111; when0001 =q=0000110; when0010 =q=1011011; when0011 =q=1001111; when0100 =q=1100110; when0101 =q=1101101; when0110 =q=1111101; when0111 =q=0100111; when1000 =q=1111111; when others =q=1101111; end case; end process; end disp_are; 天模块程序 library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity DAY is port(clk,en:in std_logic; d1,d0:out std_logic_vector(3 downto 0)); end DAY; architecture day_arc of DAY is begin process(clk) variable cnt1,cnt0:std_logic_vector(3 downto 0); begin if clkevent and clk=1 then if en=1 then if cnt1=0011 and cnt0=0000 then cnt1:=0000; cnt0:=0001; elsif cnt01001 then cnt0:=cnt0+1; else cnt0:=0000; cnt1:=cnt1+1; end if; end if; end if; d1=cnt1; d0=cnt0; end process; end day_arc; 显示模块程序 library ieee; use ieee.std_logic_1164.all; entity DISPLAY is port(d:in std_logic_vector(3 downto 0); q:out std_logic_vector(6 downto 0)); end DISPLAY; architecture disp_are of DISPLAY is begin process(d) begin case d is when0000 =q=0111111; when0001 =q=0000110; when0010 =q=1011011; when0011 =q=1001111; when0100 =q=1100110; when0101 =q=1101101; when0110 =q=1111101; when0111 =q=0100111; when1000 =q=1111111; when others =q=1101111; end case; end process; end disp_are; 小时程序模块 library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity HOUR is port(clk,en:in std_logic; h1,h0:out std_logic_vector(3 downto 0); co:out std_logic); end HOUR; architecture hour_arc of HOUR is begin process(clk) variable cnt1,cnt0:std_logic_vect

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