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官方说明书ST M28LV64 数据手册
ST M28LV64 handbook
/file/2599326
From ManualL
ManualL collects and classifies the global product
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查询M28LV64供应商
M28LV64
64K (8K x 8) LOW VOLTAGE PARALLEL EEPROM
with SOFTWARE DATA PROTECTION
NOT FOR NEW DESIGN
FAST ACCESS TIME: 200ns
SINGLE LOW VOLTAGE OPERATION
LOW POWER CONSUMPTION
FAST WRITE CYCLE:
– 64 Bytes Page Write Operation 28
– Byte or Page Write Cycle: 3ms Max
ENHANCED END OF WRITE DETECTION: 1
– Ready/Busy Open Drain Output PDIP28 (P) PLCC32 (K)
(only on the M28LV64)
– Data Polling
– Toggle Bit
PAGE LOAD TIMER STATUS BIT 28
HIGH RELIABILITY SINGLE POLYSILICON,
CMOS TECHNOLOGY: 1
– Endurance100,000 Erase/Write Cycles SO28 (MS) TSOP28 (N)
– Data Retention 40 Years 300 mils 8 x13.4mm
JEDEC APPROVED BYTEWIDE PIN OUT
SOFTWARE DATA PROTECTION
The M28LV64 is replaced by the Figure 1. Logic Diagram
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