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2018-05-06 发布于四川
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逻辑设计和数字系统no28.ppt

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清华大学电子工程系99－10－18 作者：清华大学电子工程系罗嵘 * * 用MSI设计组合逻辑电路缩小电路的体积、减小连线、提高电路的可靠性，使设计的工作量大为减少多路选择器、译码器、全加器和只读存储器逻辑函数式对照法逻辑抽象写出逻辑函数式将得到的逻辑函数式变换成与所用MSI的逻辑函数式类似的形式需要产生的逻辑函数与某种MSI的逻辑函数在形式上完全一致，使用这种MSI效果很好 MSI的逻辑函数式比所需得到的逻辑函数式更加丰富 MSI的函数式是要求产生的逻辑函数的一部分，倘若可用的MSI品种有限，而且这几种电路的逻辑函数式与希望得到的函数式之间很少有共同之处，则不宜用这几种MSI来实现。根据逻辑函数式对照比较的结果，将输入变量接到MSI对应的输入端，同时将多出的输入端视具体情况接1或0，就得到所需的电路用多路选择器实现逻辑函数例1表2.18是一个逻辑函数的真值表，用八选一多路选择器实现。 0 1 1 L Q A0 A1 D0 D1 D2 D3 A B 图2.33电路图 C A2 0 1 0 D4 D5 D6 D7 1 0 0 1 C L Q A0 A1 D0 D1 D2 D3 A B 图2.34电路图将表2.18改成表2.19的形式，可用四选一多路选择器实现（图2.34）例2表2.20是一个具有五个输入变量的逻辑函数的真值表，用三个双四选一多路选择器实现。图2.35例2五变量函数 1Q A0 A1 1D0 1D3 2Q 1S … 2D0 2D3 2S … 1Q A0 A1 1D0 1D3 2Q 1S … 2D0 2D3 2S … 1Q A0 A1 1D0 1D3 2Q 1S … 2D0 2D3 2S … 0 0 0 0 0 1 1 1 1 E E DC BA L E 0 0 1 0 1 例3利用3线－8线译码器产生一组多输出逻辑函数译码器的逻辑表达式