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河北经济管理学校教案
序号:47 编号:JL/JW/7.5.1.03
4.27
授课主题 上升沿触发与下降沿触发 教学目的 掌握上升沿触发
掌握下降沿触发
了解上升沿触发和下降沿触发的区别 教学
重点、难点 重点:上升沿触发与下降沿触发
难点:低电平触发和下降沿触发的区别? 教学准备 教案,板书,教材 教学过程设计与时间分配
一、课堂导入与提问(10min)
二、讲授新课(55min)
1.上升沿触发
2.上升沿触发应用示例
3.下降沿触发?
4.下降沿触发应用举例
5.如何将上升沿触发变为下降沿触发
6.低电平触发和下降沿触发的区别
三、课堂小结(15min)
四、布置作业(10min)
河北经济管理学校教案
教案内容 一、课堂导入与提问(10min)
回顾上节课所学内容:同步式触发
二、讲授新课(55min)
1.上升沿触发
数字电路中,数字电平从低电平(数字“0”)变为高电平(数字“1”)的那一瞬间叫作上升沿。上升沿触发是当信号有上升沿时的开关动作,当电位由低变高而触发输出变化的就叫上升沿触发。也就是当测到的信号电位是从低到高也就是上升时就触发,叫做上升沿触发。
在Verilog HDL等硬件描述语言中,最常用的两种事件分为电平触发和边沿触发,其中边沿触发即包括上升沿触发、下降沿触发。上升沿触发的写法是在符号“@“之后加上”posedge 信号名”,其中“posedge”表示信号的上升沿。
2.上升沿触发应用示例
在电子电路中,有许多触发器采用上升沿触发方式,例如D触发器(如下图所示)。
3.下降沿触发
数字电路中,数字电平从高电平(数字“1”)变为低电平(数字“0”)的那一瞬间叫作下降沿。下降沿触发是当信号有下降沿时的开关动作,当电位由高变低而触发输出变化的就叫下降沿触发。也就是当测到的信号电位是从高到低也就是下降时就触发,叫做下降沿触发。
在Verilog HDL等硬件描述语言中,最常用的两种事件分为电平触发和边沿触发,其中边沿触发即包括上升沿触发、下降沿触发。下降沿触发的写法是在符号“@“之后加上”negedge 信号名”,其中“negedge”表示信号的下降沿。
4.下降沿触发应用举例
在电子电路中,有许多触发器采用下降沿触发方式,例如主从RS触发器(如下图)、下降沿JK边沿触发器等
5.如何将上升沿触发变为下降沿触发?
在时钟信号的输入端加上一个非门即可!
触发器到底是上升沿触发还是下降沿触发,只取决于时钟,如果集成电路的时钟信号前面没有非门,即输入的时钟信号是CP,则是上升沿触发,如果有非门,即输入的时钟信号是CP(CP非),则为下降沿触发
上升沿经反向就是下降沿,在时钟输入前加个反向器,反向器输入视为总输入即可
6.低电平触发和下降沿触发的区别
低电平触发是中断允许后,只要中断引脚的信号是低电平,就触发中断,使用时注意,如果低电平一直保持,会导致多次触发中断。
下降沿触发是中断允许后,只要中断引脚的信号出现下降沿,就触发中断,使用时注意,如果信号出现抖动,会导致多次触发中断。
课堂小结(15min)
1.上升沿触发
2.下降沿触发
3.上升沿触发和下降沿触发的区别
4.低电平触发和下降沿触发的区别
四、布置作业(10min)
复习本节课所学内容
河北经济管理学校教案·电子技术基础与技能(数电) 任课教师:刘晓彤
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