(4) 与中断有关的信号 (5) CPU 初始化 (6) 电源和地 出 INTA Trap 重新启动中断 入 INTR 入 Reset in 出 Reset out VCC +5 V VSS 地 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 40 39 38 37 36 35 34 33 32 31 30 29 28 27 26 25 24 23 22 21 X1 X2 Reset out SOD SID Trap RST7.5 RST6.5 RST5.5 INTA AD0 AD1 AD2 AD3 AD4 AD5 AD6 AD7 VSS INTR VCC HOLD HLDA CLK(out) Rsest in Ready IO/M S1 RD WR ALE S0 A15 A14 A13 A12 A11 A10 A9 A8 9.2 3. 机器周期和节拍(状态)与控制信号的关系 9.2 T1 T2 T3 T4 T1 T2 T3 T1 T2 T3 M1 M2 M3 PC out PC+1 Ins IR X PC out PC+1 By Z Z out A Port IO PORT ACC byte PCL Instr PCL PCH PCH IO PORT 3MHZ
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