VHDL密码锁6位串行输入.doc

《电子设计自动化》课程设计题目： 数字密码锁电路 （1.1） 院（系） 信息科学与工程学院 专 业 15通信工程 届 别 班 级 学 号 姓 名 任课老师 数字密码锁电路，难度系数1.1 实验要求设计一个密码锁，有6位十进制数字密码，串行输入；能设置密码；有开锁和错误指示（LED）；如果连续输错三次，则一刻钟内不能再开锁。本设计的各个模块由相应的VHDL程序具体实现，并在QuartusⅡ9.0环境下进行了整体电路的模拟仿真，最终实现“密码锁设计”的要求。实验设计要求6位串行输入，并且由于实验板输入键位的有限，还同时增加了输入密码与设置密码键位的重叠，使密码锁电路输入输出形成一个反馈，通过对输出的判断，让电路自动识别输入的数字是设置的密码还是输入的密码。在程序初始载入实验板时，还要让密码锁的初始设置密码和输入密码相同，从而达到能够初始设置密码的逻辑要求。同时因为实验板输出的LED灯有限，还要求设计的密码锁电路的显示能够在输入密码、设置密码和倒计时之间灵活智能选择，从而达到满足使用的要求。密码锁在输入三次错误密码后需要开始一个一刻钟即900秒的倒计时，则需要设计一个逻辑电路使电路能够在输入和错误倒计时之间自由变化。此为本实验设计的主要难点和创新。 目录系统设计 .....................................................................4单元电路设计 .............................................................7软件设计 ...................................................................12系统测试 ...................................................................23结论 ...........................................................................24参考文献 .....................................................................24附录 ...........................................................................25其他 ...........................................................................26 系统设计设计要求：设计一个密码锁，有6位十进制数字密码，串行输入；能设置密码；有开锁和错误指示（LED）；如果连续输错三次，则一刻钟内不能再开锁。系统设计方案：先设计1.0难度的密码锁，此时不需要一刻钟计时模块。该电路首先需要一个输入模块，由于实验板的限制，安排两个键位作为输入，分别实现6个密码位的选择和对确定位密码的输入，所以在输入模块之前，还需要通过计数器来分别得到两个输入；之后设计一个密码合成及选择模块，将得到的6个4位的密码相加得到一个24位的密码，方便之后的比较，同时需要在输入模块添加一个选择，分别确定此时的输入信息是设置密码还是输入密码；将得到的24位设置密码和输入密码分别放到一个确认模块，起到输入确认并且使初始信息清零的作用；最后将两个24位数据放入比较模块，确定密码锁的状态，状态的显示由LED灯实现；输出显示LED模块从输入模块之前接出，显示当前电路的输入；同时，在计数器之前需要加入消抖模块，使实验板能够稳定输入；在LED模块之前需要添加译码器，以输出正确显示。下图为1.0密码锁各个模块及接线。 完成1.0难度密码锁之后设计一个计数器，通过对密码输入确认和输出状态的计数，当输入错误达到三次时，开始一个一刻钟的计时，由另外一个计数器完成。该计数器的输入还需要一个50m分频模块，得到一个稳定的每秒输出一个电平跳变的输入；为了将900秒的计时显示到LED上，需要用除法器将计时的各个位拆分出来，再通过译码器显示到LED上。最后还需要一个