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//=====================================================================
// AD9854 驱动程序设计
//硬件连接: P0 ——Data;
// P2 ——Adr;
// RESET ——P3^7;
// UDCLK ——P3^6;
// WR ——P3.5;
// RD ——p3.4;
// FDATA ——P3^3;
// OSK ——P3^2;
// VDD--逻辑电源(3.3V)
// VSS--GND(0V)
//AD9854.c
//writer:谷雨 2008年8月22日~24日于EDA实验室
//说明：本程序基于硬件的外接晶振为20MHZ
//=====================================================================
#include STC89C51RC.h //STC单片机头文件
#include intrins.h
#define uint unsigned int
#define uchar unsigned char
#define ulong unsigned long
uchar FreqWord[6]; //6个字节频率控制字
//**********************以下为系统时钟以及其相关变量设置**************************
/*
此处根据自己的需要设置系统时钟以及与其相关的因子，一次需且只需开启一个
CLK_Set为时钟倍频设置，可设置4~20倍倍频，但最大不能超过300MHZ
Freq_mult_ulong和Freq_mult_doulle均为2的48次方除以系统时钟，一个为长整形，一个为双精度型
*/
/*
#define CLK_Set 4
const ulong Freq_mult_ulong = 3518437;
const double Freq_mult_doulle = 3518437.2088832;
*/
/*
#define CLK_Set 5
const ulong Freq_mult_ulong = 2814750;
const double Freq_mult_doulle = 2814749
*/
#define CLK_Set 6
const ulong Freq_mult_ulong = 2345625;
const double Freq_mult_doulle = 2345624
/*
#define CLK_Set 7
const ulong Freq_mult_ulong = 2010536;
const double Freq_mult_doulle = 2010535
*/
/*
#define CLK_Set 8
const ulong Freq_mult_ulong = 1759219;
const double Freq_mult_doulle = 1759218.6044416;
*/
/*
#define CLK_Set 9
const ulong Freq_mult_ulong = 1563750;
const double Freq_mult_doulle = 1563749
*/
/*
#define CLK_Set 10
const ulong Freq_mult_ulong = 1407375;
const double Freq_mult_doulle = 1407374
*/
/*
#define CLK_Set 11
const ulong Freq_mult_ulong = 1279432;
const double Freq_mult_doulle = 1279431.712321164
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