基于IP核的ISE设计流程.pptVIP

ISE设计流程介绍--设计流程介绍 基于VHDL语言的ISE设计流程 --设计内容 该设计案例完成一个基本组合逻辑电路的设计，设计 内容包括： 1）工程的建立； 2）新文件的生成和代码的添加； 3）设计综合和查看综合结果； 4）设计仿真； 5）用户约束的添加和设计实现； 6）布局布线结果的查看； 7）设计下载到FPGA芯片 8）PROM文件的生成和下载到PROM中 基于IP核的ISE设计流程 --IP核概念介绍 IP（Intelligent Property）核是具有知识产权核的集成 电路芯核总称，是经过反复验证过的、具有特定功能的 宏模块，与芯片制造工艺无关，可以移植到不同的半导 体工艺中。 到了SOC阶段，IP核设计已成为ASIC电路设计公司 和FPGA提供商的重要任务，也是其实力体现。对于 FPGA开发软件，其提供的IP核越丰富，用户的设计就越 方便，其市场占用率就越高。目前，IP核已经变成系统 设计的基本单元，并作为独立设计成果被交换、转让和 销售。 基于IP核的ISE设计流程 --IP核概念介绍 从IP核的提供方式上，通常将其分为软核、硬核和固 核这3类。 从完成IP核所花费的成