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课程设计名称： 电子技术课程设计 题 目： 专 业： 班 级： 姓 名： 学 号： 电子技术课程设计 PAGE 16 PAGE 15 辽宁工程技术大学 课 程 设 计 成 绩 评 定 表 评 定 标 准 评定指标 标准 评定 合格 不合格 单元电路及 整体设计方案 合理性 正确性 创新性 仿真或实践 是否进行仿真 或实践 技术指标或性能符合设计要求 有完成结果 设计报告 格式正确 内容充实 语言流畅 标准说明：以上三大项指标中，每大项中有两小 项或三小项合格，视为总成绩合格。 总成绩 日期 年 月 日 课程设计任务书 一、设计题目 电子表 二、设计任务 显示小时、分、秒（可以通过两个按键调整时间） 三、设计计划 电子技术课程设计共一周 第1天：针对所选的题目查找资料，确定设计方案； 第2天：方案分析比较，电路原理设计，进行元器件参数选择； 选用芯片：74ls196、7448、LED数码管、74ls00、74ls04、按键； 第3-4天：利用protues进行仿真实验； 第5天：编写整理设计报告。 四、设计要求 画出整体电路图； 对所设计的电路进行部分或全部的仿真，使之达到设计任务要求； 写出设计报告书。 指导老师： 时 间：2012年6月20日 摘要 数字钟是采用数字电路实现对时,分,秒，数字显示的计时装置,广泛用于个人家庭,车站, 码头办公室等公共场所,成为人们日常生活中不可少的必需品,由于数字集成电路的发展和石英晶体振荡器的广泛应用,使得数字钟的精度,运运超过老式钟表, 钟表的数字化给人们生产生活带来了极大的方便而且大大地扩展了钟表原先的报时功能。因此，研究数字钟及扩大其应用，有着非常现实的意义。 数字钟计时的标准信号应该是频率相当稳定的1HZ秒脉冲，所以要设置标准时间源。 数字钟计时周期是24小时，因此必须设置24小时计数器，应由模为60的秒计数器和分计数器及模为24的时计数器组成，秒、分、时由七段数码管显示。 为使数字钟走时与标准时间一致，校时电路是必不可少的。设计中采用开关控制校时直接用秒脉冲先后对“时”“分”计数器进行校时操作。 关键词：数字钟；计数器；数码管 目录 序言 设计目的，要求 分块电路的设计 3.1时钟发生器 3.2分频器 3.3计数器 3.4 译码器和显示器 3.5校时电路 4.整体电路的设计 4.1电路的组成原理框图 5.安装调试 5.1调试要点 5.2实验室调试 6.附录 6.1主要元器件 7．心得体会 8. 参考文献 第一章 序言 一、设计课题 电子表 设计目的要求 一、设计目的 熟悉数字系统的分析和设计方法； 熟悉合理选用集成电路的方法； 掌握数字钟的设计、组装和调试方法； 培养书写设计报告的能力。 二、内容及要求 1、设计一个具有“时”、“分”、“秒”显示的电子钟（23小时59分钟59秒）。应具有校正功能。 2、用中小规模集成电路组成电子钟，并在实验向上进行组装、调试。 3、画出框图和逻辑电路图，写出设计，实验总结报告。 第三章 分块电路的设计 3.1 时钟发生器 用555定时器构成的多谐振荡器，是一种性能良好地时钟源，调节变阻器RV1使3端口输出50hz的时钟脉冲。 3.2 分频器 由于555时钟发生器产生较高的50Hz的频率，而电子钟需要秒脉冲，可采用分频电路实现，具体电路如下图所示。先经过1次五分频，在经过1次十分频，最后得到秒脉冲信号。 这里采用两片集成电路计数器74ls196作为分频器，每片分别可以构成二进制、五进制、十进制计数器，U9接在CLK2端，构成一个1/5分频器，进行串联则得到10Hz的脉冲信号，再将第二片的74ls196的CLK2与Q0相连，信号从CLK1接入构成1/10分频，最后输出1Hz的秒脉冲给计数电路 3.3 计数器 用计数器构成“时”、“分”、“秒”的计数电路，“秒”和“分”为六十进制计数器，“时”为二十四进制计数器。可以用六片十进制芯片74LS196实现 3.3.1 60进制计数器（分、秒） 将两片74LS196接成60进制计数器，分（秒）个位片为10进制，十位片为6进制。具体电路如图3所示。 .3.2 24进制计数器（时） 将两片74