第五章：组合逻辑电路(3)..pptVIP

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2019-01-08 发布于湖北
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第五章：组合逻辑电路(3)..ppt

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LCD器件采用交流驱动电路 P 为输入脉冲，其工作频率50~60HZ。 a 为译码电路输出的一个段位显示控制信号。 M 、N 为液晶电极控制信号。将输入脉冲和段位控制信号相异或，产生一个M-N的交变电压信号，使液晶显示器正常显示字符。 =1 例：设计8421BCD七段显示译码电路。解：译码、显示电路有两种接法，一种是共阳极接法，另一种是共阴极接法。本题采用共阳极设计。即：输出“0”表示LED段亮，输出“1”表示LED段灭 DCBA表示译码器输入的BCD代码。 a ~ g 表示输出的二进制代码。（用小规模集成电路设计） DC BA 00 01 11 10 00 01 11 10 a 由8421BCD七段显示译码真值表直接填卡诺图并进行化简。 DC BA 00 01 11 10 00 01 11 10 g DC BA 00 01 11 10 00 01 11 10 f DC BA 00 01 11 10 00 01 11 10 e DC BA 00 01 11 10 00 01 11 10 d DC BA 00 01 11 10 00 01 11 10 c DC BA 00 01 11 10 00 01 11 10 b ☆ e和f不是最简与或式，目的是尽可能采用公共项。 1 1 1 1 用与非门实现：每个段位两次求反，一次反演，即可画出用与非门实现的7段译码器电路图。 P169 8(1), 16, 17(2) 由以上逻辑表达式可以列出二－十进制译码器功能表。 1 1 1 1 1 1 1 1 序号输入输出 A3 A2 A1 A0 /Y0 /Y1 /Y2 /Y3 /Y4 /Y5 /Y6 /Y7 /Y8 /Y9 0 0 0 0 0 0 1 1 1 1 1 1 1 1 1 1 0 0 0 1 1 0 1 1 1 1 1 1 1 1 2 0 0 1 0 1 1 0 1 1 1 1 1 1 1 3 0 0 1 1 1 1 1 0 1 1 1 1 1 1 4 0 1 0 0 1 1 1 1 0 1 1 1 1 1 5 0 1 0 1 1 1 1 1 0 1 1 1 1 6 0 1 1 0 1 1 1 1 1 1 0 1 1 1 7 0 1 1 1 1 1 1 1 1 1 1 0 1 1 8 1 0 0 0 1 1 1 1 1 1 1 1 0 1 9 1 0 0 1 1 1 1 1 1 1 1 1 1 0 伪码 1 0 1 0 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 0 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 ★ 逻辑符号 ☆ 输入端A3~A0为8421BCD编码地址输入端。 ☆ 四－十译码器是非完全译码器。为十个译码输出端，且输出低电平有效。功能表： 3 2 1 0 0 1 2 3 4 5 6 7 8 9 0 0 0 0 0 1 1 1 1 1 1 1 1 1 0 0 0 1 1 0 1 1 1 1 1 1 1 1 0 0 1 0 1 1 0 1 1 1 1 1 1 1 0 0 1 1 1 1 1 0 1 1 1 1 1 1 0 1 0 0 1 1 1 1 0 1 1 1 1 1 0 1 0 1 1 1 1 1 1 0 1 1 1 1 0 1 1 0 1 1 1 1 1 1 0 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 0 0 0 1 1 1 1 1 1 1 1 0 1 1 0 0 1 1 1 1 1 1 1 1 1 1 0 1 0 1 0 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 0 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1010~1111为无效输入组合。伪码 BCD/DEC ★ 用4-10译码器构成3-8译码器。作3-8译码器输出。空脚不用。 A3 = 0 正常译码。 1 输出全“1” ★ 4-10译码器功能扩展。