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2019-07-15 发布于湖北
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基于CPLDFPGAAES算法混合流水实现.pdf

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第27卷第1期电子与信息学报 Vbl．27No．1 2005年1月 Jouma】ofElectmnicsInf-ornlation Jan．2005 Tbchno】ogy 基于CPLD佰PGA的AES算法混合流水实现彭艮鹏刘常澍李志华 (天津大学电子信息工程学院天津300072) 摘要：在加解密算法的硬件实现中，使用流水线结构可以显著地提高加密解密速度，但是由于这类结构并不适合于大多数的反馈模式，因而此类结构在当前密码学中的应用较少。为此，该文采用一种补偿手段，基于交叉CBc(InterleavedBlock cjpherchaining)模式，以混合流水结构成功地实现了AEsAdvancedEncIyption standard)的算法。该方案允许并行处理4个数据块(称为一次加密或解密)，同时两次加密或解密之间还可实现部分并行。该方案在EP20k300EBC652．1(Ateral公司产品)上已得到成功验证。关键词： AEs，流水线，混合流水，硬件实现，加密，解密中图分类号：TN918．4 文献标识码：A 文章编号：1009．5896(2005)01．0155．03 The ofAESin HybridPipeliningImplementation theFeedbackModeBasedonCPLD／FPGA Liu LiZhi-hua PengGen-peng Chang—shu (＆^oD，Q厂眈c打．Djc日nd坳r，口疗DnE醴gf玎P12，f，嗨砌巧f，z(加f’旧，苫而剪7了口形f玎300072，C协加口) Abstract stⅢctureinthehardware Althoughusingpipelining implementatj伽cangenerallyproVjdehigher ofthisstmctureincurrent is arenotsuitableformost limited，because thmughput，theapplication cuptography they commonf’eedbackmodes．This f．on^，arda ofthe architecture paperputs design hybridpipelining ofAES．Byincluding intheAESstalldardinterleaVedmodesof the opemtion，thedesignsuccessfullyimplementsalgorithm，whichoperates intheCBCmode．Inthis fourdatablockscanbedealtwithin or design， parallel(calledone·enc9ption atthesametime“vo or canbe hasbeen one—dec叮ption)，and enc叫pti