清华大学数电实验报告.docx

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2019-05-06 发布于贵州
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清华大学数电实验报告.docx

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清华大学数电实验报告　　一，实验结果分析　　实验一：QuartusII原理图输入法设计　　实验名称：设计实现全加器　　实验任务要求：用实验内容中生成的半加器模块和逻辑门设计实现一个全加器，仿真并验证其功能，并下载到实验板测试，要求用拨码开关设定输入信号，发光二极管显示输出信号。原理图：　　仿真波形图：　　仿真波形图分析：输入a,b代表加数与被加数，输入c代表低位向本位　　的进位。输出s代表本位和，输出co代表向高位的进位。　　可得真值表为：　　实验三：用VHDL设计与实现时序逻辑电路　　实验名称：连接8421计数器，分频器和数码管译码器　　实验任务要求：用VHDL语言设计实现一个带异步复位的8421码十　　进制计数器，分频器的分频系数为25k，并用数码管显示数字。　　VHDL代码：　　LIBRARYIEEE;　　USE_LOGIC_;USE_LOGIC_;　　entitydivisend;　　port(clk1:instd_logic;　　clk_out:outstd_logic);　　architecturedofdivisbeginend;　　LIBRARYIEEE;　　USE_LOGIC_;USE_LOGIC_;　　ENTITYcount10ISPORT(　　clk2,clear2:INSTD_LOGIC;　　q:OUTSTD_LOGIC_VECTOR(3DOWNTO0));ENDcount10;　　ARCHITECTUREcountOFcount10IS　　SIGNALq_temp:STD_LOGIC_VECTOR(3DOWNTO0);　　process(clk1)begin　　if(clk1'eventandclk1='1')thenendif;　　ifcnt=thenelseendif;　　cnt(clk2'eventANDclk2='1')THENIFq_temp="1001"THENq_tempbbbbbbbbbbB<="";ENDCASE;ENDPROCESS;cat1<="";　　ENDshow;　　LIBRARYIEEE;　　USE_LOGIC_;use_LOGIC_;entityjishuqi8421is　　port(clk,clear:INSTD_LOGIC;　　cout:OUTSTD_LOGIC_VECTOR(6DOWNTO0);cat:OUTSTD_LOGIC_VECTOR(5DOWNTO0));　　endjishuqi8421;　　国家电工电子实验教学中心　　数字电子技术基础　　实验报告　　实验题目：中频自动增益控制数字电路的研究　　XX年11月17日　　学院：班级：学生姓名：学号：任课教师：同组成员：电子信息工程学院骆丽　　目录　　1设计任务要求.....................................................1　　2设计方案及论证...................................................1　　任务分析...................................................1　　方案比较...................................................3　　系统结构设计...............................................5　　具体电路设计...............................................8　　3制作及调试过程..................................................16　　制作及调试过程..........................................16　　遇到的问题和解决方法....................................17　　仿真过程................................................17　　制作及调试过程..........................................19　　实验结果................................................20　　遇到的问题和解决方法....................................20　　4实验研究与思考..............................................