南华大学电气工程学院EDA技术及其应用课件第8章 VHDL设计深入.ppt

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2019-05-13 发布于广东
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第8章 VHDL设计深入 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.1 数据对象 8.2 含高阻输出的电路设计 8.2 含高阻输出的电路设计 8.2 含高阻输出的电路设计 8.2 含高阻输出的电路设计 8.2 含高阻输出的电路设计 8.3 顺序语句归纳 8.3 顺序语句归纳 8.4 并行赋值语句讨论 8.5 IF语句概述 8.5 IF语句概述 8.5 IF语句概述 8.6 仿真延时 8.7 VHDL的描述风格实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计实验与设计 8-3 PS2键盘控制模型电子琴电路设计 8-3 PS2键盘控制模型电子琴电路设计 8-3 PS2键盘控制模型电子琴电路设计接下页 8-3 PS2键盘控制模型电子琴电路设计 8-4. 直流电机综合测控系统设计 8-4. 直流电机综合测控系统设计 8-5 AM幅度调制信号发生器设计 * * 8.1.1 常数 8.1.2 变量 8.1.3 信号 8.1.4 进程中的信号赋值与变量赋值 8.1.4 进程中的信号赋值与变量赋值 8.1.4 进程中的信号赋值与变量赋值 8.1.4 进程中的信号赋值与变量赋值 8.1.4 进程中的信号赋值与变量赋值 8.1.4 进程中的信号赋值与变量赋值 8.1.4 进程中的信号赋值与变量赋值 8.2.1 三态门设计 8.2.2 双向端口的设计方法 8.2.2 双向端口的设计方法 8.2.3 三态总线电路设计 8.2.3 三态总线电路设计 8.3.1 进程语句格式 8.3.2 进程结构组成 8.3.3 进程要点 1. PROCESS为一无限循环语句 2. 进程中的顺序语句具有明显的顺序和并行双重性 3. 信号可以是多个进程间的通信线 4. 一个进程中只允许描述对应于一个时钟信号的同步时序逻辑 8.6.1 固有延时 8.6.2 传输延时 8.6.3 仿真 ? 8.7.1 RTL描述 8.7.2 行为描述 8.7.3 数据流描述 8.7.4 结构描述 8-1 4X4阵列键盘键信号检测电路设计 8-2 乐曲硬件演奏电路设计 8-2 乐曲硬件演奏电路设计 8-2 乐曲硬件演奏电路设计 8-2 乐曲硬件演奏电路设计 8-2 乐曲硬件演奏电路设计 *