数字电路基础和计算机中逻辑部件.pptVIP

本章主要内容 数字逻辑电路基础 基本逻辑门和布尔代数知识基础 组合逻辑电路及其应用 时序逻辑电路及其应用 现场可编程器件及其应用 阵列逻辑电路 阵列逻辑电路是指逻辑元件在硅芯片上以阵列形式排列的器件，它占用芯片面积小，成品率高，用户可编程，使用灵活。 阵列逻辑电路包括存储器(RAM,ROM)，可编程逻辑阵列(PLA)，可编程阵列逻辑(PAL)，通用阵列逻辑(GAL)，可编程门阵列(PGA)，可编程宏单元阵列(PMA)等多种类型。除了RAM和ROM之外，其它几种电路统称可编程逻辑器件(programmable logic devices，PLD)，教学计算机中用得最多的是GAL20V8和高集成度的多PAL (AMD公司的 MACH-4 产品) 芯片，将在后续部分进一步介绍，它们可以实现组合逻辑电路或者时序逻辑电路的功能，都由“与”和“或”两级阵列组成。 存储器芯片RAM和ROM RAM 和 ROM 是典型的阵列逻辑电路，都由“与”和“或”两级阵列组成，其中的与阵列组成地址译码器，它给出全部地址输入的最小项，用户不可编程，用于选择被读写的存储器单元，或阵列组成存储体，保存写入存储器中的内容。 RAM 和 ROM 的区别：前者对或阵列中的内容可以读写，后者或阵列中的内容主要用于读出，对写操作可能不支持，或者需经过特殊的办法才能执行。 有关存储器芯片的知识，将在介绍存储器的章节中重点讲解，无需在这里的线路部分多加说明，而后面的 GAL20V8 、MACH-4 和 FPGA器件的有关知识不属于本课程的重点内容，需在这里多说几句。 通用阵列逻辑GAL 通用阵列逻辑 (generic array logic，GAL) 器件，是一种可用电擦出、现场可重复编程、使用灵活的简单 PLD。 它的内部结构包括：输入门，输出三态门，与门阵列，输出逻辑宏单元(内含或阵列)，从输出反馈到输入的控制门等。GAL20V8 器件最多支持 20 个输入引脚、8 个输出引脚，支持组合逻辑和时序逻辑两种运行方式，输出有三态、极性可控，支持内部信息加密保护。 在教学计算机中，用于实现那些逻辑内容经常需要变化的组合逻辑的功能，用于实现内容经常需要变化的时序逻辑的功能，或者在不同需求环境下，需要在组合逻辑和时序逻辑之间进行切换的线路部分，特别适用于实现由“与-或”两级逻辑完成的线路功能。在实验指导书中对该器件使用方法有更多说明。 在适应变换设计、减少器件类型和数量等方面效果明显。 复杂的可编程逻辑器件CPLD:MACH器件 MACH (macro array CMOS high-density) 是一种复杂的、电可擦出的、现场可编程逻辑器件 CPLD。 它的内部结构由多个 PAL 块和一个中央开关矩阵互连而成。每个 PAL 块内又含多个宏单元（输出宏单元和隐埋宏单元），中央开关矩阵为 多个PAL 块的信号输入和块间通信提供通路。在实验指导书中对该器件结构有更详细地介绍。 与 GAL20V8 芯片相比，MACH有更多的输入输出引脚和更多的宏单元，支持的逻辑功能更加强大，使用更加方便，还支持在线编程写入。在教学计算机中，主要作为组合逻辑控制器的时序控制信号形成部件，用于提供基本指令用到的全部控制信号。 用现场可编程逻辑器件 CPLD实现组合逻辑控制器是非常方便和有效的，对理解数字系统设计自动化的知识也很有用。 可在线编程门阵列器件FPGA 这是一种与 PLD 器件在内部结构、功能特性方面都不相同的器件。其内部由许多个独立的可编程逻辑模块 CLB、输入输出模块 IOB 和互连资源 IR 3部分组成。 与 IOB 连接的输入输出引脚更多，大部分入出引脚支持三态逻辑，极性可控，可指定用于输入或输出； 每一个 CLB 的内部都包含一些组合逻辑电路和 1 或 2 个触发器电路，能编程实现不同的组合、时序逻辑线路功能。 内部互连资源由金属线、开关阵列和可编程连接点组成， 用于连接众多的 CLB 和 IOB ，以构成不同的复杂系统。 FPGA 芯片的工作状态（提供的逻辑功能）是由芯片内的编程数据存储器的内容决定的，这些数据要存在片外的 EPROM 器件中，每次重新加电后，将其装入到编程数据存储器中。 FPGA 芯片集成度更高，功能更强大，但对决定内部功能的数据不能加密，各信号的延迟时间不是固定的，需要注意。可用选用 FPGA 芯片实现简单一点的 CPU 的功能。 初学者一般从输入向输出逐级写出各个门的输出逻辑式。熟练后可从输出向输入直接推出整个电路的输出逻辑式。 　　由 Si 表达式可知，当输入有奇数个 1 时，S