IBMPCAT硬件架构与动作原理.PPTVIP

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2019-12-03 发布于江苏
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IBM PC/AT 硬體架構與動作原理;IBM PC/AT 原版電路之功能方塊的內容;Figure : Decoder(PC/AT original schematic);IBM PC/AT IO Port Addresses;8. 71H : CMOS RAM data register Port 9. 80H : Manufacturing Test Port 10. 81H~8FH : DMA page table address reg. 11. A0H~BFH : Programmable interrupt ctrl 2 12. C0H~DFH : DMA Controller 2 Register 13. F0H~FFH : Math Coprocessor regs. 14. 170H~177H : Fixed disk 1 registers 15. 1F0H~1F7H : Fixed disk 0 registers 16. 200H~20FH : Game control port 17. 201H : Game Port I/O Data 18. 278H~27AH : Parallel Port 3 registers 19.2F8H~2FFH : Serial Port 2 registers;20. 370H~377H : Diskette Controller 1 reg 21. 378H~37AH : Parallel Port 2 registers 22. 3BCH~3BEH : Parallel Port 1 registers 23. 3F0H~3FFH : Diskette Controller 0 reg 24. 3F8H~3FFH : Serial Port 1 registers 25. 3C0H~3CFH : VGA I/O Port registers;8042 Control Register(I/O Port Address : 61H);System buffer;DIR;INTA;SA0~SA19;HLDA;S1＃;MRDC#;KT9 System Block Diagram;NS87570;System Start Steps (1);1. When we push the Power Button, the signal -NBSWON will be generated and send to the PCU(PC87570). 2. As the PCU receives the -NBSWON, it will send the -DNBSWON to the south bridge(M1535+). 3. Then the SB asserts -SUSB and -SUSC signals to the PCU. 4. The PCU will send the SUSON, MAINON and –VRON for suspend power, main power and VHcore generating. ;4.1 PC87570;System Start Steps (2);System Start Steps (3);System Start Steps (4);System Start Steps (4);System Start Steps (5);System Start Steps (5);The first Execution Instruction in PC AT;POST (Power-On Self Test) Process;8. The Programmable Interrupt Timer 9. The cache controller 10. COMS RAM configuration data 11.The CRT controller 12. RAM memory above 64K 13. The keyboard 14. Diskette drive A availability 15. The serial interface circuitry 16. The diskette controller 17. The fixed disk controller 18. Any additional hardware ;AWARD BIOS POST Test code listing;C5 C6;11;IBM PC/AT System RAM Data Area;The first two words of expansion ROM area;Differenc