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摘 要
此次电子时钟的设计，是以同步加法计数器 74LS161 为基础的时序逻辑
电路设计，其有较强的实际应用性。74LS161 可以灵活的应用于各种数字电路
的设计，实现各种功能。在本设计中，我使用 74LS161 的各种级联方式实现
了多级多进制的计数并分级连接数码管，实现了电子时钟的功能。
关键词：数字时钟；计数器；级联；74LS161。
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目 录
第 1 章 设计任务 2
1.1 内容及要求2
1.2 用途2
第 2 章 设计方案2
2.1 设计思路 2
2.2 设计方案及其论证3
2.3 元器件的选择4
第 3 章 电路设计7
3.1 输入 7
3.2 计数器 7
3.3 显示输出结果 9
3.4 整体电路 . 9
第 4 章 整体电路的仿真测试及性能
10
4.1 电路的安装调试（仿真）.
11
4.2 性能指标测量及记录
..11
总结 ..
14
参考文献 .
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第 1 章 设计任务
1.1 内容及要求
电子时钟设计：设计一个具有时、分、秒的十进制数字显示的计数器。用
MULTISIM 软件实现，并用 proteus 画出 PCB 板。
1.2 用途：
此设计可以应用于各种计时器，通过调节脉冲，可以构成秒表，电子时钟
以及各种显示方案的计时/计数设备。
第 2 章 设计方案
整体思路：
本题目的要求是做一个能显示时、分、秒的计数器，那么这个电路就用该
包含 3 部分:第一部分提供周期的脉冲信号；第二部分是以第一部分为输入源的
组合计数器；第三部分是显示部分，把第二部分计数的结果按照一定的方式显
示。
2.1 设计思路
2.1.1 信号源
信号源要求是有周期的脉冲输入才能够进行计数，应选择方波输入的脉冲
信号。
2.1.2.计数器
计数器应该分为 3 部分，分别记录时、分、秒。
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2.1.3 计秒位
一分钟有 60 秒，故秒位应该用 60 进制的计数器。记秒位要显示 2 位数，
并且没有集成的 60 进制计数器，所以级联的计数器应该可以实现两位输出。
每计 60 秒秒位将会向分位进一并且本位清零。
2.1.4 计分位
一小时有 60 分钟，故分位也应该用 60 进制的计数器。和记秒位一样，记
分位同样要显示 2 位数，且没有集成 60 进制计数器，所以级联的计数器应该
可以实现两位输出。每计 60 分分位将会向小时位进一并且本位清零。
2.1.5 计小时位
一天有 24 小时（这里设计的是 24 小时制计数器），故秒位应该用24 进
制的计数器。记小时位要显示 2 位数，并且没有集成的 24 进制计数器，所以
级联的计数器应该可以实现两位输出。每计满 24 小时本位将会进行一次清零。
2.1.6 显示输出
小时、分钟、秒这 3 位每位都需要输出两位数，故总共会有 6 位数输出。
将输出显示要使用显示译码器/数码管连接到每一个计数器的输出端。
2.1.7 进位和清零
进位和清零应该是同步的，即当秒位计满 60 秒的瞬间，应该同时发出一
个进位脉冲给下一级计数器和一个本位的清零脉冲进行清零。故可以用逻辑门
在两级计数器之间进行连接以实现功能。
2.2 设计方案及其论证
按照整体思路，设计方案如下：
使用同步加法计数器 74LS161
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